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参数资料
| 型号： | PM8621-BIAP |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480 |
| 封装： | 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480 |
| 文件页数： | 83/184页 |
| 文件大小： | 1122K |
| 代理商： | PM8621-BIAP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页当前第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
82
Register 020H, 024H: CSTR #1 – 2 Control*
Bit
Type
Function
Default
Bit 31-16
Unused
X
Bit 15
R/W
Reserved[11]
0
Bit 14
R/W
Reserved[10]
0
Bit 13
R/W
Reserved[9]
0
Bit 12
R/W
Reserved[8]
0
Bit 11
R/W
Reserved[7]
0
Bit 10
R/W
Reserved[6]
1
Bit 9
R/W
Reserved[5]
0
Bit 8
R/W
Reserved[4]
0
Bit 7
R/W
Reserved[3]
0
Bit 6
R/W
Reserved[2]
0
Bit 5
R/W
Reserved[1]
0
Bit 4
R/W
CSU_ENB
0
Bit 3
R/W
CSU_RSTB
1
Bit 2
Unused
X
Bit 1
Unused
X
Bit 0
R/W
Reserved[0]
1
This register provides reset control and enable control for CSTR block #1
Reserved[11:0]
The Reserved bits must be set to the indicated default value for correct operation of the NSE.
CSU_RSTB
The CSU_RSTB signal is a software reset signal that forces the CSU into reset. The CSU is
reset when the CSU_RSTB is logic 0. The CSU is also reset by the NSE-8G master analog
reset signal. When the CSU is reset, the reset signal should be held for at least 100us.
CSU_ENB
The CSU enable control signal (CSU_ENB) bit forces the CSU into low power configuration.
The CSU is disabled when CSU_ENB is logic one. The CSU is enabled when CSU_ENB is
logic 0.
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