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参数资料
| 型号： | PM8621-BIAP |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480 |
| 封装： | 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480 |
| 文件页数： | 135/184页 |
| 文件大小： | 1122K |
| 代理商： | PM8621-BIAP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页当前第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
134
12 Operation
There are several important aspects regarding the operation of NSE-based switch fabrics; these
are dealt with in turn in the following sections.
12.1
Software Default Settings
12.1.1 Setting the T8TE Time-slot Configuration #1 Register
Set the first T8TE Time-slot Configuration register to 0000AAAAh. This sets T8TE to LPT mode
so that Low Order Path signals are encoded in outgoing 8B/10B characters. Or, set to 00005555h
to set T8TE to HPT mode to ensure V1/V2 bytes are preserved.
12.1.2 Setting the T8TE Time-slot Configuration #2 Register
Set the second T8TE Time-slot Configuration register to 000000Aah. This sets T8TE to LPT
mode so that Low Order Path signals are encoded in outgoing 8B/10B characters. Or, set to
00000055h to set T8TE to HPT mode to ensure V1/V2 bytes are preserved.
12.1.3 Configuring the NSE-8G to Use Fewer Links
The NSE-8G powers up with the software digital reset disabled, software analog reset disabled
and individual link reset enabled. This means that only the digital blocks are enabled post
hardware reset (since setting channel reset also disable the associated analog blocks). The CSU
by default will be start upon NSE-8G powers up; it can only be reset by the firmware writing
logic one to the ARESET bit in NSE-8G Master Reset register (000H). By writing logic zero to
appropriate channels in NSE-8G Individual Channel Reset register (001H) will bring the
associated link out of reset and operational for normal mode operation.
When fewer than 32/12 links are used in the NSE-8G 20G/8G, the unused links should be
disabled individually by writing logic one to the appropriate NSE-8G Individual Channel Reset
register (001H) bit. Writing logic one to bit N of NSE-8G Individual Channel Reset register will
disable the R8TD, ILC, and T8TE of channel N. This reset controls both the digital as well as the
analog reset inputs of the R8TD and T8TE. The analog reset input of R8TD and T8TE gates the
analog reset and enable output that is used to disable the associated DRU/RXLV, PISO/TXLV
analog blocks. This will cause the entire link from input N to output N to be disabled.
Reset States of Various Operation Modes
Post Hardware Reset:
Register 000H : DRESET
‘0’
Register 000H : ARESET
‘0’
Register 001H : RESET
‘0xFFFFFFFF’
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| PM871 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Analog IC |
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| PM87-3C90 | 制造商:FERROXCUBE 制造商全称:Ferroxcube International Holding B.V. 功能描述:PM cores |
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