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参数资料
| 型号： | PM8621-BIAP |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480 |
| 封装： | 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480 |
| 文件页数： | 145/184页 |
| 文件大小： | 1122K |
| 代理商： | PM8621-BIAP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页当前第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
144
If some links are switching DS0 traffic (“1 in 48” frame mode) and some are not (“1 in 4” frame
mode), the input RC1FP and the qualifying signal from the DCB (from mf_swap), will be running
at “1 in 48” frame mode. The links in “1 in 48” frame mode should use the unexpected interrupt
while the others should use the missing interrupt.
If a link no longer has any C1 activity, the firmware should assume the link has lost alignment,
and should force R8TD OCA for the port.
These instructions assume the PMC NSE-8G Device driver is not being used. If the supplied
driver is being used, this will all be handled within that driver.
12.6
DS0 Cross-Bar Switch (DCB) Operation
While the DCB is the Space Switch central to the NSE-8G it also contains the DCB C1 Delay
Register. This register must be programmed with the delay (in 77.76 MHz clock cycles) between
RC1FP (RC1DLY) and the expected arrival time in the R8TD SIPO of the C1 character. This
value is expected to be in the order of 51 clock cycles + 9720 or +1080 for SBI mode or
TeleCombus mode respectively. The 51 value is approximate and very dependant on the system
architecture and transmission line lengths between the SBS and NSE-8G components. This must
be obtained empirically by the system designer during product commissioning.
Figure 25 Architecture of the RAM Input Interface
C
D
160
160
offcfg[159:0]
B
160
160
5
160
160
5
oncfg[159:0]
R
P
P
W
30
F
.
E
30
pgNdin[159:0]
A
U
CFGO[29:0]
12.6.1 Configuring the DCB using Port Transfer Mode
In port transfer mode, the microprocessor updates only one configuration entry within a word of
offline connection memory page. The steps to perform a port transfer are shown in the following
example:
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PDF描述 |
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| PM871 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Analog IC |
| PM872 | 制造商:ARTESYN 制造商全称:Artesyn Technologies 功能描述:Single and dual output 10 to 12 Watt Nominal input DC/DC converters |
| PM87-3C90 | 制造商:FERROXCUBE 制造商全称:Ferroxcube International Holding B.V. 功能描述:PM cores |
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