参数资料
| 型号： | SC900841JVKR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 135/192页 |
| 文件大小： | 0K |
| 描述： | IC POWER MGT 338-MAPBGA |
| 标准包装： | 2,000 |
| 应用： | PC，PDA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-TFBGA |
| 供应商设备封装： | 338-MAPBGA |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DEVICE OPERATION
AUDIO
Table 82. Interface Driver Characteristics
BCL1, BCL2, FS1, FS2 Rise and Fall Time
if in Master mode
SSIDRV[1:0]=00 (default)
SSIDRV[1:0]=01
SSIDRV[1:0]=10
SSIDRV[1:0]=11
11
6
High Z
22
ns
ns
ns
ns
T clk
BCL
T c lkh
T c lkl
F S (S h o rt)
T s yn c se t
T sy n ch o ld
F S (L o n g )
T clks yn c
T c lk tx
T s yn c tx
T e n d s yn c
T h iz o u t
TX
RX
H i-Z
MS B / L SB
T s e tu p
T h o ld
M SB / LS B
H i-Z
Figure 67. Interface Timing Diagram
Table 83. Interface Timing Specifications
Parameter
t CLK
t CLKH
t CLKL
t SYNCSET
t SYNCHOLD
t CLKSYNC
t SYNCTX
t CLKTX
t ENDSYNC
t HIZOUT
t SETUP
t HOLD
Description
BCL clock frequency
BCL clock high
BCL clock low
Sync setup time for short sync (master mode)
Sync setup time for short sync (slave mode)
Sync hold time for short sync (master mode)
Sync hold time for short sync (slave mode)
Delay time from clock to long sync
Delay time from long sync to TX (slave mode)
Delay time from clock edge to TX for short sync
Delay time from BCL to long sync low after LSB
Delay time from LSB of TX to Hi-Z state
Set-up time for RX
Hold time for RX
Min
128
220
220
200
20
200
20
-
-
-
20
20
20
20
Typ
-
-
-
-
-
-
-
-
-
-
-
-
-
-
Max
2048
-
-
-
-
-
-
15
20
20
-
-
-
-
Unit
kHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
VOICE CODEC PROTOCOL
The serial interface protocol for the voice codec supports
both single word per frame and multiple words per frame
time-division multiplexed (TDM) modes, and can be used in
either master or slave mode. Master mode is selected by
setting the VCEMASTEN bit. In master mode, the voice
codec generates the bit clock and frame sync signals, as long
as the VCECLKEN bit is set. The data is transmitted and
received in a two's complement format, MSB first, and can be
clocked on the positive or negative edge of the bit clock. The
active edge of the bit clock can be selected by the
VCEBCLINV bit. The interface can operate with a short (bit
900841
Analog Integrated Circuit Device Data
Freescale Semiconductor
135
相关PDF资料 |
PDF描述 |
|---|---|
| SC900AMLTRT | IC REG LDO ADJ .2A/.15A 20-MLPQ |
| SCCSP900842R2 | IC POWER MGT 36-WLCSP |
| SG1577ASY | IC REG CTRLR BST PWM VM 20-SOIC |
| SG1577DY | IC REG CTRLR BST PWM VM 20-DIP |
| SG3525ADW | IC REG CTRLR PWM VM 16-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| SC900844JVK | 功能描述:PMIC 解决方案 PMUIC 5SW 14LDO 10BT ADC RoHS:否 制造商:Texas Instruments 安装风格:SMD/SMT 封装 / 箱体:QFN-24 封装:Reel |
| SC900844JVKR2 | 功能描述:PMIC 解决方案 PMUIC 5SW 14LDO 10BT ADC RoHS:否 制造商:Texas Instruments 安装风格:SMD/SMT 封装 / 箱体:QFN-24 封装:Reel |
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| SC900A100 | 制造商:Schneider Electric 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:Schneider-Telemacanique 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:SCHNEIDER ELECTRIC 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR |
| SC900A100FS | 制造商:Schneider Electric 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:Schneider-Telemacanique 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:SCHNEIDER ELECTRIC 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR |
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