参数资料
| 型号： | SC900841JVKR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 71/192页 |
| 文件大小： | 0K |
| 描述： | IC POWER MGT 338-MAPBGA |
| 标准包装： | 2,000 |
| 应用： | PC，PDA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-TFBGA |
| 供应商设备封装： | 338-MAPBGA |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DEVICE OPERATION
POWER SUPPLIES
VNN
This is a VID controlled single-phase 1.0 MHz 2-switch
synchronous Buck PWM voltage mode control DC/DC
regulator, designed to power high performance CPUs. VNN
uses external MOSFETs, P-ch high side and N-ch low side.
VNN includes support for VID active voltage positioning
requirements. A 7-bit DAC reads the VID input signals and
sets the output voltage level. The output voltage has a range
of 0.3 to 1.2 V. The programming step size is 12.5 mV.
Values will be read in real time and will be stored in internal
registers not accessible to the system host. Reference
The same VID input signals are shared between VNN and
VNN, where a latch signal for each regulator decides which
regulator takes control of the VID input signals.
The DAC value represents the output voltage value. The
output voltage node is connected directly to the inverting
input of the error amplifier that uses the DAC output as its
reference, unity gain configuration. Using this configuration
with internal compensation eliminates the need for the
feedback and compensation network, which saves board
space and cost. The DAC/output voltage slew rate is
internally set 25 mV/μs to minimize transient currents and
audible noise.
The switcher can operate in different modes depending on
the load conditions. These modes can be set through the SPI
and include a PFM mode, an Automatic Pulse Skipping
mode, and a PWM mode. The previous selection is optimized
to maximum battery life based on load conditions.
VNN will be discharged every time the regulator is shutting
down.
The output current is sense in the same way as it is done
The sensed output current value will also be used for over-
current protection. If an over-current condition is detected,
the regulator will limit the current through cycle by cycle
operation and alert the system through the VNNFAULT
signal, which will in turn assert the VRFAULT Interrupt signal.
V PWR
PVINNN
C INCC
HSNNGT
V NN
L NN
M HSNN
Driver
CTLVNN
AOACCTLVNN
C ONN
M LSNN
LSNNGT
Controller
PGNDNN
SWFBNN
CSPNN
Current Sense
Amp
I NN
VNNFAULT
SPI
Interface
Internal
Compensation
Z2
VOUTFBNN
Z1
EA
V REF
DAC
VIDEN0
VIDEN1
Figure 25. VNN Detailed Internal Block Diagram
Main Features
? Uses the V PWR rail as its power supply
? It is used to provide power to the Graphics Core.
? Single-Phase Solution with Integrated Drivers and
external MOSFETs
? VID Controlled for dynamic voltage scaling requirements
of high performance processors
? 1.0 MHz switching frequency
? High efficiency operating modes depending on load
conditions
? Output can be discharged through the low side switch.
? Loss-Less Output Current Sensing with over-current
protection
? Uses internal compensation
? Gate drive circuits are supplied directly from VPWR
Efficiency Curves
The following efficiency curves are calculated under PWM
mode based on the recommended external component
values and typical output voltage of 1.2. 3.0 V ≤ VPWR ≤
4.4 V.
900841
Analog Integrated Circuit Device Data
Freescale Semiconductor
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PDF描述 |
|---|---|
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参数描述 |
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