参数资料
| 型号： | SC900841JVKR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 93/192页 |
| 文件大小： | 0K |
| 描述： | IC POWER MGT 338-MAPBGA |
| 标准包装： | 2,000 |
| 应用： | PC，PDA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-TFBGA |
| 供应商设备封装： | 338-MAPBGA |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DEVICE OPERATION
POWER SUPPLIES
Table 47. VCC180CNT Register Structure and Bits Description
AOACCTLVCC180
Reserved
5:3
7:6
VCC180 State Control during AOAC Exit (when the Exit pin is EXITSTBY pin is asserted). These bits will be
initialized by the system SPI controller after power up.
X0 = Do not copy
x4 = OFF
x1 = Do not copy
x5 = Low Power
x2 = Do not copy
x6 = Active
x3 = Do not copy
x7 = Active
Reserved
VPNL18
VPNL18 is a low drop-out (LDO) fully integrated regulator
with a P-CH Pass FET. It is high performance, low noise, and
high PSRR, with a low quiescent current and fast transient
response. VPNL18 is actively discharged during shutdown.
VPNL18 shares an input voltage pin (PVIN2P1) and a
reference ground pin (GND2P1) with VCC180 and VPMIC
regulators, yet each has independent control. PVIN2P1 is
supplied from the V21 voltage.
PVIN 2P1
( Shared with VCC180 and VPMIC)
Controller
_
V REF
CTLVPNL18
V OPNL18
VOUTPNL18
C OPNL18
V OPNL18
I OPNL18
Z
+
Output Monitor
AOACCTLVPNL18
VPNL18FAULT
SPI
Interface
GND2P1
Discharge
( Shared with VCC180 and VPMIC)
Figure 45. VPNL18 Detailed Internal Block Diagram
Main Features
? Uses V21 as the main power supply
? 225 mA maximum continuous output current
? Optimized for a 2.2 μF external filter capacitor with a
maximum of 10 m Ω ESR
? Uses an internal pass FET
? The output for each LDO is monitored for over-current
conditions and under-voltage events
VPNL18 Status/Control Registers and Bits Description
Table 48. VPNL18 Control Register Structure and Bits Description
Name
CTLVPANEL18
AOACCTLVPANEL18
Reserved
Bits
2:0
5:3
7:6
Description
VPANEL18CNT (ADDR 0x46 - R/W - Default value: 0x24)
VPNL18 State Control
x0 = Reserved
x4 = OFF
x1 = Reserved
x5 = Low Power
x2 = Reserved
x6 = Active
x3 = Reserved
x7 = Active
VPNL18 State Control during AOAC Exit (when the Exit pin is EXITSTBY pin is asserted). These bits will be
initialized by the system SPI controller after power up.
X0 = Do not copy
x4 = OFF
x1 = Do not copy
x5 = Low Power
x2 = Do not copy
x6 = Active
x3 = Do not copy
x7 = Active
Reserved
900841
Analog Integrated Circuit Device Data
Freescale Semiconductor
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PDF描述 |
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