参数资料
| 型号： | SC900841JVKR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 52/192页 |
| 文件大小： | 0K |
| 描述： | IC POWER MGT 338-MAPBGA |
| 标准包装： | 2,000 |
| 应用： | PC，PDA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-TFBGA |
| 供应商设备封装： | 338-MAPBGA |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DEVICE OPERATION
SYSTEM CONTROL INTERFACE
SPECIAL REGISTERS
Vendor ID and Version ID
Table 19. General Purpose Memory FSLMEMx Register
Structure and Bits Description
The Vendor ID and other version details can be read via
the Identification bits. These are hard-wired on the chip.
Register
FSLMEMx
Name
-
Bits
7:0
Description
General Purpose Memory Register x
Table 17. Vendor ID Registers Structure and Bits
Description
Name Bits Description
Output Driver Control
Select output pins output drive capability can be
programmed for 4 different settings as shows in the following
VENDID1
ID1 (ADDR 0x00 - R - Default Value: 0x28)
2:0 Chip1 Vendor ID
tables. All of the following outputs follow the settings as
shown.
REV1
5:3
Chip1 Revision ID
Table 20. Output Driver Control Selection
Reserved
7:6
Reserved
Slope Select
Rise Time (ns)
Fall Time (ns)
ID2 (ADDR 0x01 - R - Default Value: 0x00)
0
0
8.4
7.0
VENDID2
REV2
Reserved
2:0
5:3
7:6
Chip2 Vendor ID
Chip2 Revision ID
Reserved
0
1
1
1
0
1
6.2
Hi-Z
22.3
6.2
Hi-Z
21.3
ID3 (ADDR 0x02 - R - Default Value: 0x00)
Table 21. Output Driver Register Structure and Bit
Reserved
7:0
Reserved
Description
ID4 (ADDR 0x03 - R - Default Value: 0x00)
Name
Bits
Description
Reserved
7:0
Reserved
FSLOUTDRVCNTL1 (ADDR 0x1BF - R/W - Default Value: 0x00)
Embedded Memory
There are 24 register banks of general purpose embedded
memory, accessible by the processor to store critical data
during power down. The data written to these registers is
maintained by the coin cell when the main battery is deeply
PWRGDDRV
VRCOMPBDRV
PMICINTDRV
RESETBDRV
1:0
3:2
5:4
7:6
PWRGD Output Pin Driver Capability
VRCOMP Output Pin Driver Capability
PMICINT Output Pin Driver Capability
RESETB Output Pin Driver Capability
discharged or removed, and is part of the RTC block. The
FSLOUTDRVCNTL2 (ADDR 0x1C0 - R/W - Default Value: 0x04)
content of the embedded memory is reset by RTCPORB. The
banks can be used for any system need, for bit retention with
coin cell backup.
CLK26KDRV
CLK26MDRV
V3GPAENDRV
1:0
3:2
5:4
CLK26K Output Pin Driver Capability
CLK26M Output Pin Driver Capability
V3GPAEN Output Pin Driver
Capability
Table 18. General Purpose Memory MEMx Register
Structure and Bits Description
V33ENDRV 7:6 V33EN Output Pin Driver Capability
FSLOUTDRVCNTL3 (ADDR 0x1C1 - R/W - Default Value: 0x01)
Register
MEMx
Name
-
Bits
7:0
Description
General Purpose Memory
Register x
SPISDODRV
RSVD
1:0
7:2
MISO Output Pin Driver Capability
Reserved
The rest of the 24 registers reside in the Freescale
dedicated register space.
X is from 1 to 16 in the following table
PLL Control
The following register controls the PLL and the different
divider values for different output frequencies.
900841
Analog Integrated Circuit Device Data
52
Freescale Semiconductor
相关PDF资料 |
PDF描述 |
|---|---|
| SC900AMLTRT | IC REG LDO ADJ .2A/.15A 20-MLPQ |
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| SG1577DY | IC REG CTRLR BST PWM VM 20-DIP |
| SG3525ADW | IC REG CTRLR PWM VM 16-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| SC900844JVK | 功能描述:PMIC 解决方案 PMUIC 5SW 14LDO 10BT ADC RoHS:否 制造商:Texas Instruments 安装风格:SMD/SMT 封装 / 箱体:QFN-24 封装:Reel |
| SC900844JVKR2 | 功能描述:PMIC 解决方案 PMUIC 5SW 14LDO 10BT ADC RoHS:否 制造商:Texas Instruments 安装风格:SMD/SMT 封装 / 箱体:QFN-24 封装:Reel |
| SC900A | 制造商:SEMTECH 制造商全称:Semtech Corporation 功能描述:Programmable Penta ULDO with RESET and I2C Interface |
| SC900A100 | 制造商:Schneider Electric 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:Schneider-Telemacanique 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:SCHNEIDER ELECTRIC 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR |
| SC900A100FS | 制造商:Schneider Electric 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:Schneider-Telemacanique 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR 制造商:SCHNEIDER ELECTRIC 功能描述:SUPERPROX ULTRASONIC PROXIMITY SENSOR |
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