参数资料
| 型号： | SC900841JVKR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 159/192页 |
| 文件大小： | 0K |
| 描述： | IC POWER MGT 338-MAPBGA |
| 标准包装： | 2,000 |
| 应用： | PC，PDA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 338-TFBGA |
| 供应商设备封装： | 338-MAPBGA |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DEVICE OPERATION
ADC SUBSYSTEM
Table 97. Possible Reserved Channels Usage
24
Charger Current
-300 – 300 mV (32)
x4
-1.2– +1.2 V
(V ISNSBATP – V ISNSBATN )
25
26
27
28
29
30
31
Backup Voltage (V COINCELL )
Battery Detect
Reserved
Reserved
Reserved
Reserved
Reserved
0 – 3.6 V
0 – V CORE
Reserved
Reserved
Reserved
Reserved
Reserved
x2/3
x5/6
Reserved
Reserved
Reserved
Reserved
Reserved
0 – 2.4 V
0 – 2.31 V
Reserved
Reserved
Reserved
Reserved
Reserved
Notes
32. Equivalent to -3.0 to +3.0 A of current with a 100 mOhm sense resistor
Activating the prior channels to provide the signal specified
occurs by asserting the following bits to 1. If the following bits
are 0, then these channels are reserved:
? VPWRCON for channel 22
? CHRGICON for channel 24
? LICON for channel 25
? BATDETVCON for channel 26
CONTROL
The ADC block consists of a 5-bit wide, 32-entry register
file, which stores the address of the analog input for
sampling. The 10-bit result is then stored in a separate
register file 10+1 bits wide and 32 entries deep.
In order to operate the ADC, it has to be enabled first by
setting the ADEN bit high in the ADCCNTL1 register. When
the register ADCCNTL1 ADSTRT bit is enabled, the PMIC
will cycle through the 3 + 5 bit selector addresses in registers
ADCADDRx. The high 3-bits control the touch screen bias
FETs, as described in Touch Screen Interface . The lower 5-
bits address the ADC selector to connect one of 32 channels
Table 98. ADC LSB Settings
to the ADC. The result of the ADC conversion is stored into
the result registers (ADCSNSx), along with the input gain
setting (1 MSB). An address in the selector table of 0x1F
designates the stop location of the selection loop. At which
point the interrupt flag bit 0 (RND), which can be masked
through the MRND bit in the MADCINT register, is set in
register ADCINT, bit 1 of the INTERRUPT register (ADC) is
set, and the external PMICINT signal is asserted, if bit 1 of the
INTMASK register is clear. The ADC sleeps for 0 to 27 ms as
set by ADC register ADCCNTL1 through the ADSLP[2:0] bits
and then repeats the selector cycle. The new data overwrites
the old in the result registers. At most, all 32 result registers
will be filled within 15.625 ms (2048/32 = 1/64 Hz). The result
registers will not be read until the RND flag is set.
DEDICATED CHANNELS READING
Two different LSB value settings are possible by using the
LSBSEL bit in the FSLADCCNTL register. LSBSEL = 0 is the
default setting. See Table 98 for more information
#
0
1
2
3
4
5
6
7
SELECT[4:0]
00000
00001
00010
00011
00100
00101
00110
00111
ADC INPUT SIGNAL
PMIC Die Temperature
VCC Current Sense
VNN Current Sense
VCC180 Current Sense
VDDQ Current Sense
V33 Current Sense
Battery Voltage (V BAT )
Battery Current
SIGNAL RANGE
1.2 – 2.4 V
4.2 A
1.9 A
0.5 A
1.8 A
1.7 A
4.8 V
6.0 A (-3.0 to 3.0 A)
LSB VALUE
(LSBSEL = 0)
0.4244 K
4.1015 mA
1.8554 mA
0.4883 mA
1.7578 mA
1.6602 mA
4.6875 mV
5.8594 mA
LSB VALUE
(LSBSEL = 1)
1C
10 mA
10 mA
10 mA
10 mA
10 mA
10 mV
10 mA
(V BAT – V ISNSBATN )
8
9
01000
01001
Adaptor Voltage
Battery Pack Thermistor
24 V
2.4 V
23.4375 mV
2.3438 mV
10 mV
10mV
900841
Analog Integrated Circuit Device Data
Freescale Semiconductor
159
相关PDF资料 |
PDF描述 |
|---|---|
| SC900AMLTRT | IC REG LDO ADJ .2A/.15A 20-MLPQ |
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| SG1577DY | IC REG CTRLR BST PWM VM 20-DIP |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| SC900844JVKR2 | 功能描述:PMIC 解决方案 PMUIC 5SW 14LDO 10BT ADC RoHS:否 制造商:Texas Instruments 安装风格:SMD/SMT 封装 / 箱体:QFN-24 封装:Reel |
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