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参数资料
| 型号： | EK-V6-ML630-G-J |
| 厂商： | Xilinx Inc |
| 文件页数： | 13/65页 |
| 文件大小： | 0K |
| 描述： | VIRTEX-6 HXT FPGA ML630 EVAL KIT |
| 标准包装： | 1 |
| 系列： | Virtex® 6 HXT |
| 类型： | FPGA |
| 适用于相关产品： | Virtex?-6 XC6VHX565T |
| 所含物品： | 板，线缆，软件和文档 |
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Virtex-6 FPGA Data Sheet: DC and Switching Characteristics
X-Ref Target - Figure 2
+V
0
–V
P–N
Differenti a l
Volt a ge
d s 152_02_121509
Figure 2: Differential Peak-to-Peak Voltage
Table 18 summarizes the DC specifications of the clock input of the GTX transceiver. Consult UG366 : Virtex-6 FPGA GTX
Transceivers User Guide for further details.
Table 18: GTX Transceiver Clock DC Input Level Specification
Symbol
V IDIFF
R IN
DC Parameter
Differential peak-to-peak input voltage
Differential input resistance
Min
210
90
Typ
800
100
Max
2000
130
Units
mV
Ω
C EXT
Required external AC coupling
capacitor (1)
–
100
–
nF
Notes:
1.
Other values can be used as appropriate to conform to specific protocols and standards.
GTX Transceiver Switching Characteristics
Consult UG366 : Virtex-6 FPGA GTX Transceivers User Guide for further information.
Table 19: GTX Transceiver Performance
Symbol
Description
-3
Speed Grade
-2 -1
-1L
Units
F GTXMAX
F GPLLMAX
F GPLLMIN
Maximum GTX transceiver data rate
Maximum PLL frequency
Minimum PLL frequency
6.6
3.3 (1)
1.2
6.6
3.3 (1)
1.2
5.0
2.7
1.2
5.0
2.7
1.2
Gb/s
GHz
GHz
Notes:
1.
See Table 14 for MGTAVCC requirements when PLL frequency is greater than 2.7 GHz.
Table 20: GTX Transceiver Dynamic Reconfiguration Port (DRP) Switching Characteristics
Symbol
Description
-3
Speed Grade
-2 -1
-1L
Units
F GTXDRPCLK
GTXDRPCLK maximum frequency
150
150
125
100
MHz
DS152 (v3.6) March 18, 2014
Product Specification
13
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