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参数资料
| 型号： | EK-V6-ML630-G-J |
| 厂商： | Xilinx Inc |
| 文件页数： | 22/65页 |
| 文件大小： | 0K |
| 描述： | VIRTEX-6 HXT FPGA ML630 EVAL KIT |
| 标准包装： | 1 |
| 系列： | Virtex® 6 HXT |
| 类型： | FPGA |
| 适用于相关产品： | Virtex?-6 XC6VHX565T |
| 所含物品： | 板，线缆，软件和文档 |
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Virtex-6 FPGA Data Sheet: DC and Switching Characteristics
Table 37: GTH Transceiver Receiver Switching Characteristics
Symbol
R XRL
R XPPMTOL
Description
Run length (CID)
Data/REFCLK PPM offset tolerance
Min
8000
–200
Typ
–
–
Max
–
200
Units
UI
ppm
SJ Jitter
Tolerance (1)(2)(3)(4)
JT_SJ 11.18
JT_SJ 10.32
JT_SJ 9.95
JT_SJ 2.667
JT_SJ 2.48
Sinusoidal Jitter
Sinusoidal Jitter
Sinusoidal Jitter
Sinusoidal Jitter
Sinusoidal Jitter
11.18 Gb/s
10.32 Gb/s
9.95 Gb/s
2.667 Gb/s
2.48 Gb/s
0.3
0.3
0.3
0.5
0.5
–
–
–
–
–
–
–
–
–
–
UI
UI
UI
UI
UI
Notes:
1.
2.
3.
4.
These values are NOT intended for protocol specific compliance determinations.
All jitter values are based on a bit error ratio of 1e –12 .
The frequency of the injected sinusoidal jitter is 80 MHz.
High-frequency jitter tolerance including 6 db of channel loss at a high frequency of the data rate divided by two.
Ethernet MAC Switching Characteristics
Consult UG368 : Virtex-6 FPGA Embedded Tri-mode Ethernet MAC User Guide for further information.
Table 38: Maximum Ethernet MAC Performance
Symbol
Description
Conditions
-3
Speed Grade
-2 -1
-1L
Units
F TEMACCLIENT
F TEMACPHY
Client interface maximum
frequency
Physical interface maximum
frequency
10 Mb/s – 8-bit width
100 Mb/s – 8-bit width
1000 Mb/s – 8-bit width
1000 Mb/s – 16-bit width
2000 Mb/s – 16-bit width
2500 Mb/s – 16-bit width
10 Mb/s – 4-bit width
100 Mb/s – 4-bit width
1000 Mb/s – 8-bit width
2000 Mb/s – 8-bit width
2500 Mb/s – 8-bit width
2.5 (1)
25 (2)
125
62.5
125
156.25
2.5
25
125
250
312.5
2.5 (1)
25 (2)
125
62.5
125
156.25
2.5
25
125
250
312.5
2.5 (1)
25 (2)
125
62.5
125
156.25
2.5
25
125
250
312.5
2.5 (1)
25 (2)
125
62.5
N/A
N/A
2.5
25
125
N/A
N/A
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
Notes:
1.
2.
When not using clock enable, the F MAX is lowered to 1.25 MHz.
When not using clock enable, the F MAX is lowered to 12.5 MHz.
DS152 (v3.6) March 18, 2014
Product Specification
22
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