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参数资料
| 型号： | EK-V6-ML630-G-J |
| 厂商： | Xilinx Inc |
| 文件页数： | 55/65页 |
| 文件大小： | 0K |
| 描述： | VIRTEX-6 HXT FPGA ML630 EVAL KIT |
| 标准包装： | 1 |
| 系列： | Virtex® 6 HXT |
| 类型： | FPGA |
| 适用于相关产品： | Virtex?-6 XC6VHX565T |
| 所含物品： | 板，线缆，软件和文档 |
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Virtex-6 FPGA Data Sheet: DC and Switching Characteristics
Table 66: Global Clock Input to Output Delay With MMCM
Symbol
Description
Device
-3
Speed Grade
-2 -1
-1L
Units
LVCMOS25 Global Clock Input to Output Delay using Output Flip-Flop, 12mA, Fast Slew Rate, with MMCM.
T ICKOFMMCMGC
Global Clock Input and OUTFF with
MMCM
XC6VLX75T
XC6VLX130T
XC6VLX195T
XC6VLX240T
XC6VLX365T
XC6VLX550T
XC6VLX760
XC6VSX315T
XC6VSX475T
XC6VHX250T
XC6VHX255T
XC6VHX380T
XC6VHX565T
XQ6VLX130T
XQ6VLX240T
XQ6VLX550T
XQ6VSX315T
XQ6VSX475T
2.34
2.35
2.36
2.36
2.37
N/A
N/A
2.35
N/A
2.36
2.46
2.39
N/A
N/A
N/A
N/A
N/A
N/A
2.50
2.51
2.52
2.52
2.53
2.55
2.54
2.51
2.43
2.53
2.63
2.59
2.54
2.51
2.52
N/A
2.51
N/A
2.77
2.78
2.79
2.79
2.79
2.82
2.82
2.79
2.70
2.80
2.91
2.83
2.81
2.78
2.79
2.82
2.79
2.70
2.85
2.87
2.88
2.88
2.89
2.93
2.92
2.87
2.79
N/A
N/A
N/A
N/A
2.87
2.88
2.93
2.87
2.79
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Notes:
1.
2.
Listed above are representative values where one global clock input drives one vertical clock line in each accessible column, and where all
accessible IOB and CLB flip-flops are clocked by the global clock net.
MMCM output jitter is already included in the timing calculation.
DS152 (v3.6) March 18, 2014
Product Specification
55
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