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参数资料
| 型号： | M37902FCCHP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 26 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 45/143页 |
| 文件大小： | 1148K |
| 代理商： | M37902FCCHP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页当前第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页
Corrections and Supplementary Explanation for M37902FxC Datasheet (REV.B) NO.7
Page
Error
Correction
(7/11)
Page 64,
Fig. 65,
bits 2 to 0,
bit 5, bit 6
Serial I/O mode select bits
0 0 0 : Serial I/O mode is invalid.
0 0 1 :
210
5
6
Even/Odd parity select bit
0 :
Parity enable select bit
0 :
Serial I/O mode select bits
0 0 0 : Serial I/O is invalid.
0 0 1 :
210
5
6
Odd/Even parity select bit
0:
Parity enable bit
0:
Page 66,
Fig. 68,
UART0/1
transmit/receive
control register 0,
bit 6
6
CLK polarity select bit
0 : At the falling , receive data is input.
CPL
6
CLK polarity select bit
0 : At the falling , receive data is input.
When not in transfer, pin CLK’s level
is “H”.
CPL
Page 68,
Left column,
Last line
read out the RTSk output turns back to “L”.
Page 70,
Fig. 71
s CLK porarity select bit = 1
s CLK porarity select bit = 0
s CLK porarity select bit = 0
s CLK porarity select bit = 1
Page 74,
Table 13
Pin P80/CTS0/RTS0 (Note 1)
Functions
CTS2
Pin P81/
P81 or CLK0
Pin P80/CTS0/RTS0 (Note 1)
Functions
CTS0
Pin P81/
P81 or CLK0
5
Page 77,
Left column,
Line 12
ADTRG input changes from “H” to “L” (or “L” to “H”.)
Page 77,
Left column,
Line 14
ADTRG pin is multiplexed with an analog voltage
Page 76,
Fig. 77
Ladder network
Resistor ladder network
5
Page 77,
Right column,
Lines 5 to 6
the ladder network or not
the resistor ladder network or not
5
Page 77,
Right column,
Line 10
the ladder network can be cut off by disconnecting ladder
network
the resistor ladder network can be cut off by disconnect-
ing resistor ladder network
5
Page 80,
Left column,
Line 10
, the corresponding pin (DA0 to DA2) outputs
, the corresponding pin (D-A0 to D-A2) outputs
5
相关PDF资料 |
PDF描述 |
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