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参数资料
| 型号： | EWIXP455ABT |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 266 MHz, RISC PROCESSOR, PBGA544 |
| 封装： | LEAD FREE, PLASTIC, BGA-544 |
| 文件页数： | 39/163页 |
| 文件大小： | 1123K |
| 代理商： | EWIXP455ABT |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页当前第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页
Electrical Specifications
Intel IXP45X and Intel IXP46X Product Line of Network Processors Datasheet
May 2005
Document Number: 306261-002
133
5.6.2.4
MII/SMII
Table 55.
UTOPIA Level 2 Output Timings Values
Symbol
Parameter
Min.
Max.
Units
Notes
Tclk2out
Rising edge of clock to signal output. Outputs
included in this timing are UTP_OP_SOC,
UTP_OP_FCO, UTP_IP_FCO,
UTP_OP_DATA[7:0], UTP_IP_ADDR[4:0] and
UTP_OP_ADDR[4:0].
17
ns
Tholdout
Signal output hold time after the rising edge of
the clock. Outputs included in this timing are
UTP_OP_SOC, UTP_OP_FCO, UTP_IP_FCO,
UTP_OP_DATA[7:0], UTP_IP_ADDR[4:0] and
UTP_OP_ADDR[4:0].
1ns
NOTES:
1. Timing was designed for a system load between 5pF and 25pF
Figure 21.
SMII Output Timings
Table 56.
SMII Output Timings Values
Symbol
Parameter
Min.
Max.
Units
Notes
T1
Clock to output delay for SMII_TXD[4:0] and
SMII_SYNC with respect to rising edge of
SMII_CLK
1.5
5
ns
T2
SMII_TXD[4:0] and SMII_SYNC hold time after
SMII_CLK.
1.5
ns
NOTES:
1. Timing was designed for a system load between 5pF and 15pF
SMII_CLK
SMII_OUTPUTS
T
1
T
2
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