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参数资料
| 型号： | EWIXP455ABT |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 266 MHz, RISC PROCESSOR, PBGA544 |
| 封装： | LEAD FREE, PLASTIC, BGA-544 |
| 文件页数： | 51/163页 |
| 文件大小： | 1123K |
| 代理商： | EWIXP455ABT |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页当前第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页
Electrical Specifications
May 2005
Intel IXP45X and Intel IXP46X Product Line of Network Processors Datasheet
144
Document Number: 306261-002
Figure 35.
Motorola* Multiplexed Mode
Table 68.
Motorola* Multiplexed Mode Values (Sheet 1 of 2)
Symbol
Parameter
Min.
Max.
Units
Notes
Talepulse
Pulse width of ALE (ADDR is valid at the rising edge of ALE)
1
4
Cycles
Tale2addrhold Valid address hold time after from falling edge of ALE
1
Cycles
Tdval2valds
Write data valid prior to EXP_MOT_DS_N falling edge
1
4
Cycles
NOTES:
1. The EX_ALE signal is extended form T to 4T nnsec, based on the programming of the T1 timing parameter.
The parameter Tale2addrhold is fixed at T.
2. Setting the address phase parameter (T1) will adjust the duration that the address appears to the external
device.
3. Setting the data setup phase parameter (T2) will adjust the duration that the data appears prior to a data
strobe (read or write) to an external device.
4. Setting the data strobe phase parameter (T3) will adjust the duration that the data strobe appears (read or
write) to an external device. Data will be available during this time as well.
5. Setting the data hold strobe phase parameter (T4) will adjust the duration that the chip selects, address,
and data (during a write) will be held.
6. Setting the recovery phase parameter (T5) will adjust the duration between successive accesses on the
expansion interface.
7. T is the period of the clock measured in ns.
8. Clock to output delay for all signals will be a maximum of 15 ns for devices requiring operation in
synchronous mode.
9. Timing was designed for a system load between 5pF and 60pF for high drive setting
A9587-01
EX_CLK
EX_ADDR
EX_DATA
EX_RD_N
(exp_mot_rnw)
EX_WR_N
(exp_mot_ds_n)
EX_DATA
EX_ALE
Valid Address
T5
1-16 Cycles
T4
1-4 Cycles
EX_CS_N
Trecov
Tale2addrhold
Tdval2valds
EX_WR_N
(exp_mot_ds_n)
EX_RD_N
(exp_mot_rnw)
Tdhold2afterds
T3
1-16 Cycles
T2
1-4 Cycles
T1
2-5 Cycles
ALE Extended
Talepulse Tale2valcs
Tdspulse
Address
Output Data
Address
Input Data
Multiplexed Address/Data
Trdsetup
Trdhold
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