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参数资料
| 型号： | FUSION878A |
| 厂商： | CONEXANT SYSTEMS |
| 元件分类： | 颜色信号转换 |
| 英文描述： | COLOR SIGNAL DECODER, PQFP128 |
| 封装： | PLASTIC, QFP-128 |
| 文件页数： | 75/180页 |
| 文件大小： | 2067K |
| 代理商： | FUSION878A |
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6.0 Control Register Definitions–Function 1
Fusion 878A
6.3 Local Registers (Memory Mapped)
PCI Video Decoder
6-12
Conexant
100600B
[21]
RW
0
DA_MLB
Selects most significant or LSB format for ADATA
0 = MSB first for I2S format
1 = LSB first for Sony format
[20:16]
RW
00000
DA_LRD
Specifies how many ASCLK clocks to delay from the rising edge of
ALRCK before sampling the internal parallel audio data.
[15]
RW
0
DA_DPM
Specifies mode of 3-wire digital audio input interface.
0 = Digital audio mode
1 = Data packet frame synchronized mode
[14]
RW
0
DA_SBR
Specifies number of bits that the digital audio decimation filter will
transfer out of the final stage.
0 = 16-bit samples
1 = Rounded 8-bit samples
[13]
RW
0
DA_ES2
Enables Digital Decimation Filter (DDF).
0 = Disables DDF
1 = Enable DDF stage 2 and associated decimation factor of 2
[12]
RW
0
DA_LMT
Enables detection of audio data 0x8000 (0x80) and replacement with
0x8001 (0x81). Mode determined by bit 14, DA_SBR.
0 = Disables
1 = Enables
[11:8]
RW
0000
DA_SDR
Specifies the DDF first stage and decimation rate. Range: 4 to 15.
[7:6]
RW
00
DA_IOM
Specifies audio digital audio I/O mode.
00 = DA_IOM_AFE (audio A/D)
01 = DA_IOM_DA (digital audio in)
10 = Reserved
11 = Reserved
[5]
RW
0
DA_APP
Enables Parallel Data mode (DA_IOM = 01) or High Speed Serial mode
(DA_IOM = 00).
0 = Disables
1 = Enables Parallel (DA_IOM = 01) / High Speed Serial (DA_IOM =
00).
[4]
RW
0
ACAP_EN
Enables audio capture into the audio FIFO.
0 = Disables
1 = Enables
[3:2]
RW
00
PKTP
Packed mode FIFO trigger point. Specifies number of DWORDs in the
FIFO before the DMA controller begins to burst data onto the PCI bus.
00 = PKTP_4 4 DWORDs
01 = PKTP_8
8 DWORDs
10 = PKTP_16
16 DWORDs
11 = Reserved
[1]
RW
0
RISC_ENABLE
Enables the audio DMA controller to process audio sample data flow
instructions beginning at the RISC program start address.
0 = Disables
1 = Enables
[0]
RW
0
FIFO_ENABLE
Enables the audio data FIFO.
0 = Flushes/resets audio data FIFO
1 = Enables audio data FIFO
Bits
Type
Default
Name
Description
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PDF描述 |
|---|---|
| FVXO-HC53BR-FREQ | VCXO, CLOCK, 0.75 MHz - 250 MHz, HCMOS OUTPUT |
| FVXO-HC72BR-FREQ | VCXO, CLOCK, 0.75 MHz - 180 MHz, HCMOS OUTPUT |
| FVXO-HC73B-FREQ | VCXO, CLOCK, 0.75 MHz - 250 MHz, HCMOS OUTPUT |
| FVXO-LC52BR-FREQ | VCXO, CLOCK, 0.75 MHz - 1000 MHz, LVDS OUTPUT |
| FVXO-LC72BR-FREQ | VCXO, CLOCK, 0.75 MHz - 1000 MHz, LVDS OUTPUT |
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