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参数资料
| 型号： | HW-V5-ML561-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 113/140页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 产品变化通告： | Adapter Replacement 23/May/2008 Development Systems Discontinuation 16/Jan/2012 |
| 标准包装： | 1 |
| 系列： | Virtex®-5 LXT |
| 类型： | FPGA |
| 适用于相关产品： | XC5VLX50T-FFG1136 |
| 所含物品： | 开发平台，小型闪存卡，缆线，DDR2 DIMM，电源和软件 |
| 相关产品： | XC5VLX50T-3FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-3FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA 更多... |
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R
FPGA #3 Pinout
Table A-3:
FPGA #3 Pinout (Continued)
Signal Name
Pin
Signal Name
Pin
RLDRAM II Memory Interface (cont.)
RLD2_DQ_BY3_B4
RLD2_DQ_BY3_B5
RLD2_DQ_BY3_B6
M7
N7
N8
RLD2_DQ_BY3_B7
RLD2_DQ_BY3_B8
M5
M6
FPGA #3 Clock and Reset Signals
CLK_TO_FPGA3_MGT_N
CLK_TO_FPGA3_MGT_P
DIRECT_CLK_TO_FPGA3_N
DIRECT_CLK_TO_FPGA3_P
D4
E4
AH22
AG22
EXT_CLK_TO_FPGA3_N
EXT_CLK_TO_FPGA3_P
FPGA3_LOW_FREQ_CLK
FPGA3_RESET_N_IN
AG13
AH12
AH20
AH14
FPGA #3 MII Link Interface
FPGA1_TO_FPGA3_MII_TX_CLK
FPGA1_TO_FPGA3_MII_TX_DATA0
FPGA1_TO_FPGA3_MII_TX_DATA1
FPGA1_TO_FPGA3_MII_TX_DATA2
AE14
AE16
AF15
AF21
FPGA1_TO_FPGA3_MII_TX_DATA3
FPGA1_TO_FPGA3_MII_TX_EN
FPGA1_TO_FPGA3_MII_TX_ERR
FPGA1_TO_FPGA3_MII_TX_SPARE
AF20
AD20
AE21
AF14
FPGA #3 Configuration Signals
FPGA_INIT
FPGA_PROGB
FPGA_TMS
FPGA_VBATT
FPGA3_CCLK
FPGA3_CNFG_M0
FPGA3_CNFG_M1
FPGA3_CNFG_M2
N14
M22
AC14
L23
N15
AD21
AC22
AD22
FPGA3_D_IN
FPGA3_DONE
FPGA3_DOUT_B
FPGA3_HSWAPEN
FPGA3_TCK
FPGA3_TDI_IN
FPGA3_TDO
P15
M15
AD15
M23
AB15
AC15
AD14
FPGA #3 Test and Debug Signals
FPGA3_DIP0
FPGA3_DIP1
FPGA3_DIP2
FPGA3_DIP3
FPGA3_SPYHOLE_BK12
FPGA3_SPYHOLE_BK13
FPGA3_TEST_HDR_BY0_B0
FPGA3_TEST_HDR_BY0_B1
FPGA3_TEST_HDR_BY0_B2
Virtex-5 FPGA ML561 User Guide
AG18
AG15
AH15
AG20
R8
AG32
AE23
AE22
AG12
FPGA3_TEST_HDR_BY0_B3
FPGA3_TEST_HDR_BY0_B4
FPGA3_TEST_HDR_BY0_B5
FPGA3_TEST_HDR_BY0_B6
FPGA3_TEST_HDR_BY0_B7
FPGA3_TEST_HDR_BY1_B0
FPGA3_TEST_HDR_BY1_B1
FPGA3_TEST_HDR_BY1_B2
FPGA3_TEST_HDR_BY1_B3
AF13
AG23
AF23
AE12
AE13
AE24
AD24
AD25
AD26
113
UG199 (v1.2.1) June 15, 2009
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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