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参数资料
| 型号： | HW-V5-ML561-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 23/140页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 产品变化通告： | Adapter Replacement 23/May/2008 Development Systems Discontinuation 16/Jan/2012 |
| 标准包装： | 1 |
| 系列： | Virtex®-5 LXT |
| 类型： | FPGA |
| 适用于相关产品： | XC5VLX50T-FFG1136 |
| 所含物品： | 开发平台，小型闪存卡，缆线，DDR2 DIMM，电源和软件 |
| 相关产品： | XC5VLX50T-3FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-3FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA 更多... |
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R
Memory Details
DDR2 SDRAM DIMM
The FPGA #2 device on the Virtex-5 FPGA ML561 Development Board is connected to
DDR2 memories. The DDR2 memory interface includes a 144-bit wide DIMM connection
to up to five 240-pin DDR2 DIMM sockets.
For the 144-bit wide DIMM datapath, the data bytes are spread across multiple banks of
the FPGA #2 device. Figure 3-4 summarizes the distribution of DDR2 DIMM interface
signals among the different banks of the FPGA #2 device.
BANK 124
TX 0, 1
BANK 5 (20)
BANK 23 (40)
BANK 120
BANK 20 (40)
DDR2 DIMM
BANK 3 (20)
Gener a l I/O
BANK 19 (40)
DDR2 DIMM
RX 0, 1
DQ 8, 9, 10
Control s & DIMM1 Cntl
BANK 116
BANK 1 (20)
Gener a l I/O
BANK 15 (40)
DDR2 DIMM
GTP CLK
DQ 0, 1, 2
BANK 112
BANK 12 (40)
DDR2 DIMM
BANK 11 (40)
DDR2 DIMM
BANK 114
DQ 11, 12, CB8_15
(Config u r a tion)
BANK 0
DQ 6, 3 CB0_7
BANK 13 (40)
DDR2 DIMM
DQ 5, 7, 4
BANK 118
BANK 122
BANK 126
BANK 18 (40)
DDR2 DIMM
DQ 14, 15, 13
BANK 22 (40)
DDR2 DIMM
DIMM 4 & 5 Cntl
BANK 2 (20)
Inter-FPGA MII Link s
BANK 4 (20)
Glo ba l Clock Inp u t s
BANK 6 (20)
BANK 17 (40)
DDR2 DIMM
Common Control s
BANK 21 (40)
DDR2 DIMM
DIMM 1, 2, 3 Cntl
BANK 25 (40)
UG199_c3_04_050106
Figure 3-4:
FPGA #2 Banks for DDR2 DIMM (SSTL18) Interfaces (Top View)
Virtex-5 FPGA ML561 User Guide
UG199 (v1.2.1) June 15, 2009
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参数描述 |
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