参数资料
| 型号： | HW-XGI-VIDEO-US |
| 厂商： | Xilinx Inc |
| 文件页数： | 28/68页 |
| 文件大小： | 0K |
| 描述： | DAUGHTER CARD VIDEO I/O VIODC |
| 标准包装： | 1 |
| 其它名称： | 122-1506 HW-XGI-VIDEO-US-ND |
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Chapter 3: Component and S-Video Interfaces
R
Analog Output Signal Conditioning
Output analog signals are first conditioned to meet standards requirements and then
connected to the red, green and blue RCA type connectors X2, X4 and X6 respectively.
Analog output is conditioned by a combination of passive and active circuits, as illustrated
ADV7403 Configuration Modes
Refer to the ADV7403 data sheet for details configuring the ADV7403 device.
The ADV7403 is mapped to I2C address 0x40/0x41.
Table 3-1: Configuration Modes for ADV7403 Video Decoder Chip
Register
Name
Register
Address
Register
Value
Description
525P
Primary
Mode
0x05
0x01
Video
0x06
0x08
[2:0] =PRIM_MODE
Standard
Enable
0x1D
0x47
[3:0]= VID_STD
XTAL
ADC Power
0x3a
0x10
latch clock = 13-55 MHz
and PLL
Bias Control
TLLC
0x3b
0x3c
0x80
0x5c
External Bias Enable'
PLL qpump
Control
0x6b
0x85
0x86
0xb3
0xC2
0x18
0x0b
0xfe
[3:0]cpop_sel(1=20-bit,2=30-bit)
Turn off SSPD as sync is on Y
ENABLE SDTI line count mode
SDTI
ADC sw1
0xc3
0x54
[7:4]=adc1
[3:0]=adc0
ADC sw2
0xc4
0x86
[7]=sw_en,
[6]=SOG
[3:0]=adc2
28
0x0e
0x52
0x54
0x0e
0x80
0x46
0x00
0x00
Startup sequence
Video Input/Output Daughter Card
UG235 (v1.2.1) October 31, 2007
相关PDF资料 |
PDF描述 |
|---|---|
| ICD15S13E6GV00LF | CONN DSUB HD SOCKT 15POS R/A PCB |
| ICD26S13E4GX00LF | CONN DSUB HD SOCKT 26POS R/A PCB |
| ID09S33E4GV00LF | CONN RCPT 9POS R/A GOLD |
| ID451000 | CONN RECPT USB A ADAPTER |
| IELHK11-1-72-70.0-01-V | CIRCUIT BREAKER HYMAG DP 70A |
相关代理商/技术参数 |
参数描述 |
|---|---|
| HWXX35338TR | 制造商:Vishay Intertechnologies 功能描述: |
| HWXX38438 | 制造商:Vishay Semiconductors 功能描述: |
| HWZ1408 | 制造商:OHIO BUCKEYE 功能描述: |
| HWZ1424 | 制造商:OHIO BUCKEYE 功能描述: |
| HWZ1620 | 制造商:OHIO BUCKEYE 功能描述: |
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