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参数资料
| 型号： | M68HC705UGANG |
| 厂商： | 飞思卡尔半导体(中国)有限公司 |
| 英文描述： | High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| 中文描述： | 高密度互补金属氧化物半导体（HCMOS）微控制器 |
| 文件页数： | 46/112页 |
| 文件大小： | 809K |
| 代理商： | M68HC705UGANG |
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6-2
MC68HC05BD3
PULSE WIDTH MODULATION
6
The value of each PWM Data Register is continuously compared with the content of an internal
counter to determine the state of each PWM channel output pin. Double buffering is not used in
this PWM design.
Figure 6-1
8-Bit PWM Output Waveforms
M=$00
32T=16
μ
s
M=$01
M=$0F
M=$1F
T=1 CPU clock period (0.5
μ
s if CPU clock=2MHz)
M = value set in 5-bit PWM (bit3-bit7)
N = value set in 3-bit BRM (bit0-bit2)
Pulse inserted at end of PWM cycle
depends on setting of N.
N
PWM cycles where pulses are inserted in a 8-cycle frame
Number of inserted
pulses in a 8-cycle frame
1
2
4
xx1
x1x
1xx
4
2, 6
1, 3, 5, 7
31T
16T
16T
31T
T
T
TPG
44
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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参数描述 |
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