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参数资料
| 型号： | MCR705JP7CDWE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 7/164页 |
| 文件大小： | 0K |
| 描述： | MCU 8BIT 224B RAM 28-SOIC |
| 标准包装： | 26 |
| 系列： | HC05 |
| 核心处理器： | HC05 |
| 芯体尺寸： | 8-位 |
| 速度： | 2.1MHz |
| 连通性： | SIO |
| 外围设备： | POR，温度传感器，WDT |
| 输入/输出数： | 22 |
| 程序存储器容量： | 6KB（6K x 8） |
| 程序存储器类型： | OTP |
| RAM 容量： | 224 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 4x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 包装： | 管件 |
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Core Timer
MC68HC705JJ7 MC68HC705JP7 Advance Information Data Sheet, Rev. 4.1
104
Freescale Semiconductor
periodically by a program sequence. Writing a logic 0 to COPC bit in the COPR register clears the COP
watchdog and prevents a COP reset.
EPMSEC — EPROM Security((1)) Bit
The EPMSEC bit is a write-only security bit to protect the contents of the user EPROM code stored in
locations $0700–$1FFF.
OPT — Optional Features Bit
The OPT bit enables two additional features: direct drive by comparator outputs to port A and voltage
offset capability to sample capacitor in analog subsystem.
1 = Optional features enabled
0 = Optional features disabled
COPC — COP Clear Bit
This write-only bit resets the COP watchdog. The COP watchdog is active in the run, wait, and halt
modes of operation if the COP is enabled by setting the COPEN bit in the MOR. The STOP instruction
disables the COP watchdog by clearing the counter and turning off its clock source.
In applications that depend on the COP watchdog, the STOP instruction can be disabled by setting the
SWAIT bit in the MOR. In applications that have wait cycles longer than the COP timeout period, the
COP watchdog can be disabled by clearing the COPEN bit. Table 10-2 summarizes recommended
conditions for enabling and disabling the COP watchdog.
NOTE
If the voltage on the IRQ/VPP pin exceeds 1.5 × VDD, the COP watchdog
turns off and remains off until the IRQ/VPP pin voltage falls below
1.5
× VDD.
Address:
$1FF0
Bit 7
6
5
4321
Bit 0
Read:
OPT
Write:
EPMSEC
COPC
Reset:
Unaffected by reset
= Unimplemented
Figure 10-4. COP and Security Register (COPR)
1. No security feature is absolutely secure. However, Freescale’s strategy is to make reading or copying the EPROM/OTPROM
difficult for unauthorized users.
Table 10-2. COP Watchdog Recommendations
Voltage on
IRQ/VPP Pin
SWAIT
(in MOR)(1)
1. The SWAIT bit in the MOR converts STOP instructions to HALT instructions.
Wait/Halt Time
Recommended COP
Watchdog Condition
Less than 1.5
× VDD
1
Less than COP
timeout period
Enabled(2)
2. Reset the COP watchdog immediately before executing the WAIT/HALT instruction.
Less than 1.5
× VDD
1
Greater than COP
timeout period
Disabled
Less than 1.5
× VDD
0
X(3)
3. Don’t care
Disabled
More than 1.5
× VDD
X
X(3)
Disabled
相关PDF资料 |
PDF描述 |
|---|---|
| MCHC705JP7CDWE | IC MCU 8BIT 224 BYTES RAM 28SOIC |
| LF13WBJ-20P | CONN JACK WATERPROOF 20POS MALE |
| MK20DX128VMP5 | IC ARM CORTEX MCU 128KB 64BGA |
| MC908AP8ACBE | IC MCU 8K FLASH 8MHZ 42-SDIP |
| VE-2N2-IY-F2 | CONVERTER MOD DC/DC 15V 50W |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MCR706A | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:Silicon Controlled Rectifiers |
| MCR706AT4 | 功能描述:SCR 400V 4A RoHS:否 制造商:STMicroelectronics 最大转折电流 IBO:480 A 额定重复关闭状态电压 VDRM:600 V 关闭状态漏泄电流（在 VDRM IDRM 下）:5 uA 开启状态 RMS 电流 (It RMS): 正向电压下降:1.6 V 栅触发电压 (Vgt):1.3 V 最大栅极峰值反向电压:5 V 栅触发电流 (Igt):35 mA 保持电流（Ih 最大值）:75 mA 安装风格:Through Hole 封装 / 箱体:TO-220 封装:Tube |
| MCR706AT4G | 功能描述:SCR THY 4A 400V SCR RoHS:否 制造商:STMicroelectronics 最大转折电流 IBO:480 A 额定重复关闭状态电压 VDRM:600 V 关闭状态漏泄电流（在 VDRM IDRM 下）:5 uA 开启状态 RMS 电流 (It RMS): 正向电压下降:1.6 V 栅触发电压 (Vgt):1.3 V 最大栅极峰值反向电压:5 V 栅触发电流 (Igt):35 mA 保持电流（Ih 最大值）:75 mA 安装风格:Through Hole 封装 / 箱体:TO-220 封装:Tube |
| MCR707A | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:Silicon Controlled Rectifiers |
| MCR708A | 功能描述:SCR 600V 4A RoHS:否 制造商:STMicroelectronics 最大转折电流 IBO:480 A 额定重复关闭状态电压 VDRM:600 V 关闭状态漏泄电流（在 VDRM IDRM 下）:5 uA 开启状态 RMS 电流 (It RMS): 正向电压下降:1.6 V 栅触发电压 (Vgt):1.3 V 最大栅极峰值反向电压:5 V 栅触发电流 (Igt):35 mA 保持电流（Ih 最大值）:75 mA 安装风格:Through Hole 封装 / 箱体:TO-220 封装:Tube |
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