参数资料
型号: AD9557BCPZ
厂商: Analog Devices Inc
文件页数: 16/92页
文件大小: 0K
描述: IC CLOCK TRANSLATOR 40LFCSP
产品变化通告: Minor Mask Change 11/Apr/2012
标准包装: 1
类型: 时钟/频率转换器
PLL:
主要目的: 以太网,SONET/SDH
输入: CMOS,LVDS,LVPECL
输出: CMOS,HSTL,LVDS
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 是/是
频率 - 最大: 1.25GHz
电源电压: 1.71 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 40-VFQFN 裸露焊盘,CSP
供应商设备封装: 40-LFCSP-VQ(6x6)
包装: 托盘
Data Sheet
AD9557
Rev. B | Page 23 of 92
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A
MPL
IT
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D
E
(V)
TIME (ns)
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2pF LOAD
09197-
126
Figure 25. Output Waveform,
3.3 V CMOS (100 MHz, Strong Mode)
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TIME (ns)
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10pF LOAD
2pF LOAD
09197-
127
Figure 26. Output Waveform, 1.8 V CMOS (100 MHz)
0
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A
MPL
IT
U
D
E
(V)
TIME (ns)
10pF LOAD
2pF LOAD
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128
Figure 27. Output Waveform, 3.3 V CMOS (20 MHz, Weak Mode)
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FREQUENCY OFFSET (Hz)
LOO
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AI
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(
d
B)
09197-
129
LOOP BW = 100Hz;
HIGH PHASE MARGIN;
PEAKING: 0.06dB; –3dB: 69Hz
LOOP BW = 2kHz;
HIGH PHASE MARGIN;
PEAKING: 0.097dB; –3dB: 1.23kHz
LOOP BW = 5kHz;
HIGH PHASE MARGIN;
PEAKING: 0.14dB; –3dB: 4.27kHz
Figure 28. Closed-Loop Transfer Function for 100 Hz, 2 kHz, and 5 kHz Loop
Bandwidth Settings; High Phase Margin Loop Filter Setting
(This is compliant with Telcordia GR-253 jitter transfer test for loop
bandwidths < 2 kHz.)
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FREQUENCY OFFSET (Hz)
LOO
P
G
AI
N
(
d
B)
10k
100k
09197-
230
LOOP BW = 100Hz;
NORMAL PHASE MARGIN;
PEAKING: 0.09dB; –3dB: 117Hz
LOOP BW = 2kHz;
NORMAL PHASE MARGIN;
PEAKING: 1.6dB; –3dB: 2.69kHz
Figure 29. Closed-Loop Transfer Function for 100 Hz and 2 kHz Loop
Bandwidth Settings; Normal Phase Margin Loop Filter Setting
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PDF描述
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