参数资料
| 型号： | AD9557BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 70/92页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK TRANSLATOR 40LFCSP |
| 产品变化通告： | Minor Mask Change 11/Apr/2012 |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，HSTL，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.25GHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 40-LFCSP-VQ（6x6） |
| 包装： | 托盘 |
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AD9557
Data Sheet
Rev. B | Page 72 of 92
Table 63. Base Digital Loop Filter with Normal Phase Margin (PM = 70°, BW = 0.1 Hz, Pole Frequency = 2 Hz, N1 = 1)1
Address
Bits
Bit Name
Description
0x0323
[7:0]
NPM Alpha-0 linear
Alpha-0 coefficient linear bits [7:0]
0x0324
[7:0]
Alpha-0 coefficient linear bits [15:8]
0x0325
7
Reserved
[6:0]
NPM Alpha-1 exponent
Alpha-1 coefficient exponent bits [6:0]
0x0326
[7:0]
NPM Beta-0 linear
Beta-0 coefficient linear bits [7:0]
0x0327
[7:0]
Beta-0 coefficient linear bits [15:8]
0x0328
7
Reserved
[6:0]
NPM Beta-1 exponent
Beta-1 coefficient exponent bits [6:0]
0x0329
[7:0]
NPM Gamma-0 linear
Gamma-0 coefficient linear bits [7:0]
0x032A
[7:0]
Gamma-0 coefficient linear bits [15:8]
0x032B
7
Reserved
[6:0]
NPM Gamma-1 exponent
Gamma-1 coefficient exponent bits [6:0]
0x032C
[7:0]
NPM Delta-0 linear
Delta-0 coefficient linear bits [7:0]
0x032D
[7:0]
Delta-0 coefficient linear bits [15:8]
0x032E
7
Reserved
[6:0]
NPM Delta-1 exponent
Delta-1 coefficient exponent bits [6:0]
1
Note that the digital loop filter base coefficients (α, β, γ, and δ) have the general form: x(2y), where x is the linear component and y the exponential component of the
coefficient. The value of the linear component (x) constitutes a fraction, where 0 ≤ x ≤ 1. The exponential component (y) is a signed integer.
OUTPUT PLL CONFIGURATION (REGISTER 0x0400 TO REGISTER 0x0408)
Table 64. Output PLL Setting1
Address
Bits
Bit Name
Description
0x0400
[7:0]
Output PLL (APLL)
charge pump current
LSB = 3.5 A
00000001b = 1 × LSB; 00000010b = 2 × LSB
11111111b = 255 × LSB
Default: 0x81 = 451 A CP current
0x0401
[7:0]
APLL N divider
Division = 14 to 255
Default: 0x14 = divide-by-20
0x0402
[7:0]
Reserved
0x0403
[7:6]
APLL loop filter control
Pole 2 resistor, Rp2; default: 0x07
Rp2 ()
Bit 7
Bit 6
500 (default)
0
333
0
1
250
1
0
200
1
[5:3]
Zero resistor, Rzero
Rzero ()
Bit 5
Bit 4
Bit 3
1500 (default)
0
1250
0
1
1000
0
1
0
930
0
1
1250
1
0
1000
1
0
1
750
1
0
680
1
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