参数资料
型号: AD9557BCPZ
厂商: Analog Devices Inc
文件页数: 4/92页
文件大小: 0K
描述: IC CLOCK TRANSLATOR 40LFCSP
产品变化通告: Minor Mask Change 11/Apr/2012
标准包装: 1
类型: 时钟/频率转换器
PLL:
主要目的: 以太网,SONET/SDH
输入: CMOS,LVDS,LVPECL
输出: CMOS,HSTL,LVDS
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 是/是
频率 - 最大: 1.25GHz
电源电压: 1.71 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 40-VFQFN 裸露焊盘,CSP
供应商设备封装: 40-LFCSP-VQ(6x6)
包装: 托盘
AD9557
Data Sheet
Rev. B | Page 12 of 92
SERIAL PORT SPECIFICATIONS—SPI MODE
Table 15.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
AA
CSEE
Input Logic 1 Voltage
2.2
V
Input Logic 0 Voltage
1.2
V
Input Logic 1 Current
44
A
Input Logic 0 Current
88
A
Input Capacitance
2
pF
SCLK
Internal 30 k pull-down resistor
Input Logic 1 Voltage
2.2
V
Input Logic 0 Voltage
0.8
1.2
V
Input Logic 1 Current
200
A
Input Logic 0 Current
1
A
Input Capacitance
2
pF
SDIO
As an Input
Input Logic 1 Voltage
2.2
V
Input Logic 0 Voltage
1.2
V
Input Logic 1 Current
1
A
Input Logic 0 Current
1
A
Input Capacitance
2
pF
As an Output
Output Logic 1 Voltage
DVDD3 0.6
V
1 mA load current
Output Logic 0 Voltage
0.4
V
1 mA load current
SDO
Output Logic 1 Voltage
DVDD3 0.6
V
1 mA load current
Output Logic 0 Voltage
0.4
V
1 mA load current
TIMING
SCLK
Clock Rate, 1/tCLK
40
MHz
Pulse Width High, tHIGH
10
ns
Pulse Width Low, tLOW
13
ns
SDIO to SCLK Setup, tDS
3
ns
SCLK to SDIO Hold, tDH
6
ns
SCLK to Valid SDIO and SDO, tDV
10
ns
AA
CSEE
AA
to SCLK Setup (tS)
10
ns
AA
CSEE
AA
to SCLK Hold (tC)
0
ns
AA
CSEE
AA
Minimum Pulse Width High
6
ns
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