参数资料
| 型号： | AD9557BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 63/92页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK TRANSLATOR 40LFCSP |
| 产品变化通告： | Minor Mask Change 11/Apr/2012 |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，HSTL，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.25GHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 40-LFCSP-VQ（6x6） |
| 包装： | 托盘 |
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AD9557
Data Sheet
Rev. B | Page 66 of 92
SYSTEM CLOCK (REGISTER 0x0100 TO REGISTER 0x0108)
Table 42. System Clock PLL Feedback Divider (N3 Divider)
Address
Bits
Bit Name
Description
0x0100
[7:0]
SYSCLK N3 divider
System clock PLL feedback divider value: 4 ≤ N3 ≤ 255 (default: 0x08).
Table 43. SYSCLK Configuration
Address
Bits
Bit Name
Description
0x0101
[7:5]
Reserved
Reserved.
4
Load from ROM (read only)
This read-only bit is set if the PINCONTROL pin was high during the last RESET or
power-on.
0 = The PINCONTROL pin was low at power-on (or reset).
1 = The PINCONTROL pin was high at power-on (or reset).
3
SYSCLK XTAL enable
Enables the crystal maintaining amplifier for the system clock input.
1 (default) = crystal mode (crystal maintaining amplifier enabled).
0 = external XO or other system clock source.
[2:1]
SYSCLK P divider
System clock input divider.
00 (default) = 1.
01 = 2.
10 = 4.
11 = 8.
0
SYSCLK doubler enable
Enable clock doubler on system clock input to reduce noise.
0 = disable.
1 (default) = enable.
Table 44. Nominal System Clock Period
Address
Bits
Bit Name
Description
0x0103
[7:0]
Nominal system clock period (fs)
System clock period, Bits[7:0].
Default: 0x0E.
0x0104
[7:0]
System clock period, Bits[15:8].
Default: 0x67.
0x0105
[7:5]
Reserved
Reserved.
[4:0]
Nominal system clock period (fs)
System clock period, Bits[20:16].
Default: 0x13.
Table 45. System Clock Stability Period
Address
Bits
Bit Name
Description
0x0106
[7:0]
System clock stability period (ms)
System clock period, Bits[7:0].
Default: 0x32 (0x000032 = 50 ms).
0x0107
[7:0]
System clock period, Bits[15:8].
Default: 0x00.
0x0108
[7:5]
Reserved
Reserved.
4
Reset SYSCLK stability timer
This autoclearing bit resets the system clock stability timer.
[3:0]
System clock stability period
System clock period, Bits[19:16].
Default: 0x00.
相关PDF资料 |
PDF描述 |
|---|---|
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| AD9547BCPZ | IC CLOCK GEN/SYNCHRONIZR 64LFCSP |
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相关代理商/技术参数 |
参数描述 |
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| AD9558BCPZ | 功能描述:IC CLOCK TRANSLATOR 64LFCSP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 专用 系列:- 标准包装:1 系列:- 类型:时钟/频率发生器，多路复用器 PLL:是 主要目的:存储器，RDRAM 输入:晶体 输出:LVCMOS 电路数:1 比率 - 输入:输出:1:2 差分 - 输入:输出:无/是 频率 - 最大:400MHz 电源电压:3 V ~ 3.6 V 工作温度:0°C ~ 85°C 安装类型:表面贴装 封装/外壳:16-TSSOP（0.173"，4.40mm 宽） 供应商设备封装:16-TSSOP 包装:Digi-Reel® 其它名称:296-6719-6 |
| AD9558BCPZ-REEL7 | 功能描述:IC CLK XLATR PLL 1250MHZ 64LFCSP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 专用 系列:- 标准包装:28 系列:- 类型:时钟/频率发生器 PLL:是 主要目的:Intel CPU 服务器 输入:时钟 输出:LVCMOS 电路数:1 比率 - 输入:输出:3:22 差分 - 输入:输出:无/是 频率 - 最大:400MHz 电源电压:3.135 V ~ 3.465 V 工作温度:0°C ~ 85°C 安装类型:表面贴装 封装/外壳:64-TFSOP （0.240"，6.10mm 宽） 供应商设备封装:64-TSSOP 包装:管件 |
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