参数资料
型号: AD9557BCPZ
厂商: Analog Devices Inc
文件页数: 2/92页
文件大小: 0K
描述: IC CLOCK TRANSLATOR 40LFCSP
产品变化通告: Minor Mask Change 11/Apr/2012
标准包装: 1
类型: 时钟/频率转换器
PLL:
主要目的: 以太网,SONET/SDH
输入: CMOS,LVDS,LVPECL
输出: CMOS,HSTL,LVDS
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 是/是
频率 - 最大: 1.25GHz
电源电压: 1.71 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 40-VFQFN 裸露焊盘,CSP
供应商设备封装: 40-LFCSP-VQ(6x6)
包装: 托盘
AD9557
Data Sheet
Rev. B | Page 10 of 92
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
OUTPUT TIMING SKEW
10 pF load
Between OUT0 and OUT1
10
70
ps
HSTL mode on both drivers; rising edge only;
any divide value
Additional Delay on One Driver by
Changing Its Logic Type
HSTL to LVDS
5
+1
+5
ps
Positive value indicates that the LVDS edge is
delayed relative to HSTL
HSTL to 1.8 V CMOS
5
0
+5
ps
Positive value indicates that the CMOS edge is
delayed relative to HSTL
OUT1 HSTL to OUT0 3.3 V CMOS,
Strong Mode
3.53
3.59
ns
The CMOS edge is delayed relative to HSTL
1
The listed values are for the slower edge (rise or fall).
TIME DURATION OF DIGITAL FUNCTIONS
Table 11.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
TIME DURATION OF DIGITAL FUNCTIONS
EEPROM-to-Register Download Time
13
20
ms
Using default EEPROM storage sequence
(see Register 0x0E10 to Register 0x0E3F)
Register-to-EEPROM Upload Time
138
145
ms
Using default EEPROM storage sequence
(see Register 0x0E10 to Register 0x0E3F
Minimum Power-Down Exit Time
1
ms
Time from power-down exit to system clock lock detect
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