参数资料
| 型号： | AD9557BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 64/92页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK TRANSLATOR 40LFCSP |
| 产品变化通告： | Minor Mask Change 11/Apr/2012 |
| 标准包装： | 1 |
| 类型： | 时钟/频率转换器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，HSTL，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.25GHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 40-LFCSP-VQ（6x6） |
| 包装： | 托盘 |
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Data Sheet
AD9557
Rev. B | Page 67 of 92
GENERAL CONFIGURATION (REGISTER 0x0200 TO REGISTER 0x0214)
Multifunction Pin Control (M3 to M0) and IRQ Pin Control (Register 0x0200 to Register 0x0209)
Note that the default setting for the M3 to M0 multifunction pins and the IRQ pin is that of a 3-level logic input at startup. Setting Bit 1 in
Register 0x0200 to 1 enables normal M3 to M0 pin functionality.
Table 46. Multifunction Pins (M0 to M3) Control
Address
Bits
Bit Name
Description
0x0200
[7:1]
Reserved
0
Enable M pins and IRQ pin function
0 (default) = disables the function of the M pins and the IRQ pin control register
(Address 0x0201 to Address 0x0209); the M pins and IRQ pin are in 3-level logic
input state.
1 = the M pins and IRQ pin are out of 3-level logic input state and enable the
binary function of the M pins and the IRQ pin control registers (Address 0x0201
to Address 0x0209).
0x0201
7
M0 output/
A
input
E
In/out control for M0 pin.
0 = input (2-level logic control pin).
1 (default) = output (2-level logic status pin).
[6:0]
Function
See Table 124 and Table 125. Default: 0xB0 = REFA valid.
0x0202
7
M1 output/
A
input
E
In/out control for M1 pin (same as M0).
[6:0]
Function
See Table 124 and Table 125. Default: 0xB1 = REFB valid.
0x0203
7
M2 output/
A
input
E
In/out control for M2 pin (same as M0).
[6:0]
Function
See Table 124 and Table 125. Default: 0xC0 = REFA active.
0x0204
7
M3 output/
A
input
E
In/out control for M3 pin (same as M0).
[6:0]
Function
See Table 124 and Table 125. Default: 0xC1 = REFB active.
0x0205
[7:0]
Reserved
Reserved.
0x0206
[7:0]
Reserved
Reserved.
0x0207
[7:0]
Reserved
Reserved.
0x0208
[7:0]
Reserved
Reserved.
Table 47. IRQ Pin Output Mode
Address
Bits
Bit Name
Description
0x0209
[7:5]
Reserved
[4:3]
Status signal at IRQ pin[1:0]
This selection is valid only when Address 0x0209[2] = 1
00 = DPLL phase locked
01 = DPLL frequency locked
10 = system clock PLL locked
11 (default) = (DPLL phase locked) AND (system clock PLL locked) AND (APLL locked)
2
Use IRQ pin for status signal
0 = uses IRQ pin to monitor IRQ event
1 (default) = uses IRQ pin to monitor internal status signals
[1:0]
IRQ pin driver type
Select the output mode of the IRQ pin
00 = NMOS, open drain (requires an external pull-up resistor)
01 = PMOS, open drain (requires an external pull-down resistor)
10 = CMOS, active high
11 (default) = CMOS, active low
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