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参数资料
| 型号： | ADUC7033BSTZ-88-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 106/140页 |
| 文件大小： | 0K |
| 描述： | IC BATT SENSOR PREC 48LQFP |
| 标准包装： | 2,000 |
| 功能： | 电池监控器 |
| 电源电压： | 3.5 V ~ 18 V |
| 工作温度： | -40°C ~ 115°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-LQFP（7x7） |
| 包装： | 带卷 (TR) |
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ADuC7033
WAKE-UP (WU) PIN
The wake-up (WU) pin is a high voltage GPIO controlled
through HVCON and HVDAT.
WU Pin Circuit Description
The WU pin is configured by default as an output with an
internal 10 kΩ pull-down resistor and high-side FET driver.
The WU pin, in its default mode of operation, is specified to
generate an active high system wake-up request by forcing the
external system WU bus high. User code can assert the WU
output by writing directly to HVCFG0[4].
Note that the output responds only after the 10 μs latency
through the (serial communication based) high voltage
interface.
The internal FET is capable of sourcing significant current and,
therefore, substantial on-chip self-heating can occur if this
driver is asserted for a long time period. For this reason, a
monoflop (a 1.3-second timeout timer) is included.
VDD
By default, the monoflop is enabled and disables the wake-up
driver after 1.3 seconds. It is possible to disable the monoflop
through HVCFG1[1]. If the wake-up monoflop is disabled, then
the wake-up driver should be disabled after 1.3 seconds.
The WU pin also features a short-circuit detection feature.
When the wake-up pin sources more than 100 mA typically for
400 μs, a high voltage interrupt is generated with HVMON[0] set.
A thermal shutdown event disables the WU driver. The WU
driver must be re-enabled manually after a thermal event using
HVCFG1[3]. It is possible to disable the automatic shutdown
during a thermal event via HVCFG0[7].
The WU pin can be configured in I/O mode by writing a 1 to
HVCFG1[4]. In this mode, a rising or falling edge immediately
generates a high voltage interrupt. HVMON[7] directly reflects
the state of the external WU pin. This comparator has a trip
level of 3 V TYP .
SHORT-CIRCUIT
PROTECTION
OUTPUT CONTROL
HVMON[0]
400μs
GLITCH
IMMUNITY
SHORT-CIRCUIT
TRIP REFERENCE
INTERNAL
SENSE
RESISTOR
NORMAL
HVCFG0[4]
HVCFG1[0]
6k ?
O/C
DIAGNOSTIC
RESISTOR
EXTERNAL
WU PIN
EXTERNAL
WAKE BUS
NORMAL
HVMON[7]
3V
R1
6.6k ?
INTERNAL
10k ?
EXTERNAL
CURRENT-LIMIT
RESISTOR
39 ?
C LOAD
91nF
R LOAD
1k ?
ENABLE
READBACK
R2
3.3k ?
RESISTOR
HVCFG1[4]
IO_VSS
Figure 41. WU Circuit, Block Diagram
Rev. B | Page 106 of 140
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