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参数资料
| 型号： | ADUC7033BSTZ-88-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 36/140页 |
| 文件大小： | 0K |
| 描述： | IC BATT SENSOR PREC 48LQFP |
| 标准包装： | 2,000 |
| 功能： | 电池监控器 |
| 电源电压： | 3.5 V ~ 18 V |
| 工作温度： | -40°C ~ 115°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-LQFP（7x7） |
| 包装： | 带卷 (TR) |
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ADuC7033
MEMORY MAPPED REGISTERS
The memory mapped register (MMR) space is mapped into the
top 4 kB of the MCU memory space and accessed by indirect
addressing, load, and store commands through the ARM7
banked registers. An outline of the memory mapped register
The MMR space provides an interface between the CPU and all
on-chip peripherals. All registers except the ARM7 core registers
(described in the ARM Registers section) reside in the MMR area.
Listing (Table 19 to Table 30), the MMR data widths vary from
1 byte (8 bits) to 4 bytes (32 bits). The ARM7 core can access
any of the MMRs (single byte or multiple byte width registers)
with a 32-bit read or write access.
The resulting read, for example, is aligned per little endian
format as previously the Memory Mapped Registers section and
illustrated in Figure 12. However, errors result if the ARM7 core
tries to access 4-byte (32-bit) MMRs with a 16-bit access. In the
case of a (16-bit) write access to a 32-bit MMR, the (upper) 16
most significant bits are written as 0s. More obviously, in the
case of a 16-bit read access to a 32-bit MMR, only 16 of the
MMR bits can be read.
0xFFFFFFFF
0xFFFF1000
0xFFFF0E00
0xFFFF0D50
0xFFFF0D00
0xFFFF0A14
0xFFFF0A00
0xFFFF0894
0xFFFF0880
0xFFFF0810
0xFFFF0800
0xFFFF079C
0xFFFF0780
0xFFFF0730
0xFFFF0700
0xFFFF0580
0xFFFF0500
0xFFFF044C
0xFFFF0400
0xFFFF0394
0xFFFF0380
0xFFFF0370
FLASH CONTROL
INTERFACE
GPIO
SPI
SERIAL TEST
INTERFACE
HV INTERFACE
LIN/BSD
HARDWARE
UART
ADC
PLL AND
OSCILLATOR CONTROL
GENERAL-PURPOSE
TIMER 4
WATCHDOG
TIMER 3
0xFFFF0360
0xFFFF0350
WAKE-UP
TIMER 2
0xFFFF0340
0xFFFF0334
GENERAL-PURPOSE
TIMER 1
0xFFFF0320
0xFFFF0318
TIMER 0
0xFFFF0300
0xFFFF0244
REMAP AND
SYSTEM CONTROL
0xFFFF0220
0xFFFF0110
INTERRUPT
CONTROLLER
0xFFFF0000
Figure 16. Top Level MMR Map
Rev. B | Page 36 of 140
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PDF描述 |
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参数描述 |
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