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参数资料
| 型号： | ADUC7033BSTZ-88-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 124/140页 |
| 文件大小： | 0K |
| 描述： | IC BATT SENSOR PREC 48LQFP |
| 标准包装： | 2,000 |
| 功能： | 电池监控器 |
| 电源电压： | 3.5 V ~ 18 V |
| 工作温度： | -40°C ~ 115°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-LQFP（7x7） |
| 包装： | 带卷 (TR) |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页当前第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页
ADuC7033
Bit
7
6
5
4
3
2
1
0
Description
Sync Timer Stop Edge Type Bit.
Cleared to 0 by user code to stop the sync timer on the falling edge count configured through the LHSCON1[7:4]
register.
Set to 1 by user code to stop the sync timer on the rising edge count configured through the LHSCON1[7:4] register.
Mode of Operation Bit.
Cleared to 0 by user code to select LIN mode of operation.
Set to 1 by user code to select BSD mode of operation.
Enable Compare Interrupt Bit.
Cleared to 0 by user code to disable compare interrupts.
Set to 1 by user code to generate an LHS interrupt (IRQEN[7]) when the value in LHSVAL0 (LIN synchronization bit timer)
= the value in the LHSCMP register. The LHS Compare Interrupt Bit LHSSTA[3] is set when this interrupt occurs. This
configuration is used in BSD write mode to allow user code to correctly time the output pulse widths of BSD bits to be
transmitted.
Enable Stop Interrupt.
Cleared to 0 by user code to disable interrupts when a stop condition occurs.
Set to 1 by user code to generate an interrupt when a stop condition occurs.
Enable Start Interrupt.
Cleared to 0 by user code to disable interrupts when a start condition occurs.
Set to 1 by user code to generate an interrupt when a start condition occurs.
LIN Sync Enable Bit.
Cleared to 0 by user code to disable LHS functionality.
Set to 1 by user code to enable LHS functionality.
Edge Counter Clear Bit.
Set to 1 by user code to clear the internal edge counters in the LHS peripheral.
This bit is automatically cleared to 0 after a 15 μs delay.
LHS Reset Bit.
Set to 1 by user code to reset all LHS logic to default conditions.
This bit is automatically cleared to 0 after a 15 μs delay.
Rev. B | Page 124 of 140
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