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参数资料
| 型号： | ADUC7033BSTZ-88-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 130/140页 |
| 文件大小： | 0K |
| 描述： | IC BATT SENSOR PREC 48LQFP |
| 标准包装： | 2,000 |
| 功能： | 电池监控器 |
| 电源电压： | 3.5 V ~ 18 V |
| 工作温度： | -40°C ~ 115°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-LQFP（7x7） |
| 包装： | 带卷 (TR) |
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ADuC7033
BIT SERIAL DEVICE (BSD) INTERFACE
LHS INTERRUPT
IRQEN[7]
LHS
INTERRUPT
LOGIC
FOUR LIN
INTERRUPT
SOURCES
BREAK LHSSTA[0]
ADuC7033
LHS
HARDWARE
START LHSSTA[1]
STOP LHSSTA[2]
BREAK
ERROR LHSSTA[4]
VDD
LIN ENABLE
(INTERNAL
VDD
MASTER ECU
5MHz
LHSVAL0
PULL-UP)
HVCFG0[5]
PROTECTION
DIODE
131kHz
LHSVAL1
RxD ENABLE
LHSCON0[8]
INPUT
VOLTAGE
THRESHOLD
REFERENCE
EXTERNAL
LIN PIN
MASTER ECU
PULL-UP
RxD
C LOAD
ADuC7033
UART
LIN MODE
HVCFG0[1:0]
OVER
VOLTAGE
PROTECTION
SCR
TxD
BPF
OUTPUT
DISABLE
INTERNAL
SHORT-CIRCUIT
SENSE
RESISTOR
INTERNAL
SHORT-CIRCUIT
TRIP REFERENCE
Figure 52. BSD I/O Hardware Interface
IO_VSS
BSD is a pulse-width modulated signal with three possible
?
When writing bits, user code toggles a GPIO pin and uses
states: sync, zero, and one. These are detailed, together with
their associated tolerances, in Table 96. The frame length is
19 bits and communication occurs at 1200 bps ± 3%.
Table 96. BSD Bit Level Description
the LHSCAP and LHSCMP registers to time pulse widths
and generate an interrupt when the BSD output pulse
width has reached its required width.
The ADuC7033 MMRs required for BSD communication are as
Parameter
Min
Typ
Max
Unit
follows:
TxD Rate
Bit Encoding
t SYNC
t 0
t 1
1164
1/16
5/16
10/16
1200
2/16
6/16
12/16
1236
3/16
8/16
14/16
bps
t PERIOD
t PERIOD
t PERIOD
LHSSTA:
LHSCON0:
LHSVAL0:
LHSCON1:
LIN hardware sync status register.
LIN hardware sync control register.
LIN hardware sync Timer0 (16-bit timer).
LIN hardware sync edge setup register.
BSD COMMUNICATION HARDWARE INTERFACE
The ADuC7033 emulates the BSD communication protocol
using a GPIO, an IRQ, and the LIN synchronization hardware,
all of which are under software control.
BSD RELATED MMRS
ADuC7033 emulates the BSD communication protocol using a
software (bit bang) interface with some hardware assistance
form LIN hardware synchronization logic. In effect, the
ADuC7033 BSD interface uses the following protocols:
?
An internal GPIO signal (GPIO_12) that is routed to the
external LIN/BSD pin and is controlled directly by
software to generate 0s and 1s.
?
When reading bits, the LIN synchronization hardware uses
LHSVAL1:
LHSCAP:
LHSCMP:
IRQEN/CLR:
FIQEN/CLR:
GP2DAT:
GP2SET:
GP2CLR:
LIN sync break timer.
LIN sync capture register.
LIN sync compare register.
Enable interrupt register.
Enable fast interrupt register.
GPIO data register.
GPIO set register.
GPIO clear register.
LHSVAL1 to count the width of the incoming pulses so
that user code can interpret the bits as sync, 0, or 1.
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