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参数资料
| 型号： | DS34T108GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 102/366页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 484HSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 30 |
| 类型： | TDM（分时复用） |
| 应用： | 数据传输 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA 裸露焊盘 |
| 供应商设备封装： | 484-HSBGA（23x23） |
| 包装： | 托盘 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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Bank1 Timeslot Assignment Registers
Ports 1 to 4: 0x000+(port-1)*0x80+ts*4
Ports 5 to 8: 0x400+(port-5)*0x80+ts*4
Bank2 Timeslot Assignment Registers
Ports 1 to 4: 0x200+(port-1)*0x80+ts*4
Ports 5 to 8: 0x600+(port-5)*0x80+ts*4
Bits
Data Element Name
R/W
Reset
Value
Description
[31:21]
Reserved
-
None
Must be set to zero
[20]
Remote_loop
R/W
None
When set, establishes a loop (per timeslot) between the
data received from the Ethernet port and the data
transmitted towards the Ethernet port.
Notes:
Usually the remote loop is activated on all timeslots
assigned to a bundle.
Only the TDM data is looped back. CAS information is not
looped back.
Available only when interface is configured to single clock
mode (Port[n]_cfg_reg.Two_clocks=0).
[19]
Local_loop
R/W
None
When set, establishes a loop (per timeslot) between the
data received from the TDM port and the data transmitted
towards the TDM port. The data transmitted towards the
TDM port is delayed by one TDM frame vs. the received
data.
Notes:
Usually the local loop is activated on all timeslots
assigned to a bundle.
Only the TDM data is looped back. CAS information is not
looped back.
Available only when interface is configured to single clock
mode (Port[n]_cfg_reg.Two_clocks=0).
[18]
Structured_type
R/W
Must be set for timeslots that are part of AAL1/CESoPSN
bundles whose type is structured or structured-with-CAS.
[17:16]
Timeslot_width
R/W
None
00 = Reserved
01 =2 bits (only for HDLC bundles)
10 = 7 bits (only for HDLC bundles)
11 = 8 bits
See section 10.6.4 for additional details.
[15]
First_in_bundle
R/W
None
Must be set for the first timeslot of an AAL1 or CESoPSN
bundle. Must be cleared for HDLC bundles.
[14]
Rx_assigned
R/W
None
0 = timeslot is not assigned for the Rx path
1 = timeslot is assigned for the Rx path
[13]
Transmit_assigned
R/W
None
0 = timeslot is not assigned for the transmit path
1 = timeslot is assigned for the transmit path
[12:7]
Bundle_number
R/W
None
Number of the bundle that the timeslot is assigned to.
[6:5]
Reserved
R/W
None
Must be set to zero
[4:0]
Jitter_buffer_index
R/W
None
Jitter buffer index. This field indicates which jitter buffer is
being used for the timeslot or bundle. It is also the index
into the Jitter Buffer Status Table (section 11.4.8).
If a timeslot is assigned to a bundle, the jitter buffer index
must be configured to the number of the first timeslot
assigned to the bundle. Otherwise, it must be configured
to the timeslot number. See section 10.6.10.
相关PDF资料 |
PDF描述 |
|---|---|
| DS34T104GN+ | IC TDM OVER PACKET 484TEBGA |
| DS34T101GN+ | IC TDM OVER PACKET 484TEBGA |
| MIC2211-GOYML TR | IC REG LDO 1.8V/2.9V 10-MLF |
| MIC2211-GJYML TR | IC REG LDO 1.8V/2.5V 10-MLF |
| MIC2211-SGYML TR | IC REG LDO 3.3V/1.8V 10-MLF |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS34T108GN+ | 功能描述:以太网 IC Octal TDM Over Packet Chip RoHS:否 制造商:Micrel 产品:Ethernet Switches 收发器数量:2 数据速率:10 Mb/s, 100 Mb/s 电源电压-最大:1.25 V, 3.45 V 电源电压-最小:1.15 V, 3.15 V 最大工作温度:+ 85 C 封装 / 箱体:QFN-64 封装:Tray |
| DS35 | 制造商:LUMILEDS 制造商全称:LUMILEDS 功能描述:power light source Luxeon Dental |
| DS3500N+ | 制造商:Maxim Integrated Products 功能描述:- Rail/Tube |
| DS3500N+T&R | 制造商:Maxim Integrated Products 功能描述:- Tape and Reel |
| DS3501 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:High-Voltage, NV, I2C POT with Temp Sensor and Lookup Table |
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