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参数资料
| 型号： | DS34T108GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 59/366页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 484HSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 30 |
| 类型： | TDM（分时复用） |
| 应用： | 数据传输 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA 裸露焊盘 |
| 供应商设备封装： | 484-HSBGA（23x23） |
| 包装： | 托盘 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
151 of 366
11.3 Global Registers
Functions contained in the global registers include device ID, CLAD configuration, TDMoP to framer connections,
block resets, and block interrupt status. The global register base address is 0x108,000.
Table 11-2. Global Registers
Addr
Offset
Register Name
R/W
Description
Page
0x00
R/W
Global Control Register 1
04
R/W
Global Control Register 2
08
R/W
Global Transceiver Reset Register
0C
RO
Identification Device Register
10
RO
Global Transceiver Interrupt Status Register
14
R/W
Global Transceiver Interrupt Mask Register
18
R/W
Framer and TDM-over-Packet Internal Signal Manager 1
1C
R/W
Framer and TDM-over-Packet Internal Signal Manager 2
20
R/W
Framer and TDM-over-Packet Internal Signal Manager 3
24
R/W
Framer and TDM-over-Packet Internal Signal Manager 4
GCR1 (Global Control Register) 0x00
Bits
Data Element Name
R/W
Default
Description
[31:24]
TSSYNCPEn
R/W
0
Transmit System Frame/Multiframe Sync Pin Enable
Bit 31 is TSSYNCPE8; bit 24 is TSSYNCPE1. These bits enable
the TSYNCn/TSSYNCn pin to be TSSYNCn when set. The
TSSYNCn pin should be enabled for any framer where the
transmit elastic store is enabled.
0 = Pin is TSYNCn
1 = Pin is TSSYNCn
[23:15]
INTMODEn
-
0
When GCR1.MODE=0, all ports are configured for internal mode
and these bits are ignored. When GCR1.MODE=1, INTMODEn
configures port n as follows:
0 = External Mode
1 = Internal Mode
These bits are only available on the DS34T108. See section 8 for
details.
[14]
SYSCLKS
R/W
0
TDMoP System Clock Frequency Select
When a 25MHz clock is applied to the CLK_SYS pin (i.e. when
the CLK_SYS_S pin is high), this bit configures the CLAD2 block
to provide either a 50MHz clock or a 75MHz clock to the TDMoP
block. When CLK_SYS_S=0 this bit is a don’t care. See section
10.4.
0 = 50MHz
1 = 75MHz
[13:12]
FREQSEL
R/W
00
Frequency Select
Specifies the frequency of the signal applied to the CLK_HIGH
pin.
00 = 38.88MHz (CLAD bypass; 38.88MHz in and out).
01 = 19.44MHz
10 = 10.000MHz
11 = 77.76MHz
[11]
UNFRMMODE
R/W
0
Unframed Mode
Specifies framed or unframed connection between the framers
and the TDMoP block. Affects all ports. Only valid in internal
mode (GCR1.MODE=0). Ignored in external mode. See
section 8.1.
0 = Framed mode
1 = Unframed mode
Note: When framing is not needed, the framer still has to be setup
to bypass the framer to work properly in Unframed mode.
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PDF描述 |
|---|---|
| DS34T104GN+ | IC TDM OVER PACKET 484TEBGA |
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| MIC2211-GJYML TR | IC REG LDO 1.8V/2.5V 10-MLF |
| MIC2211-SGYML TR | IC REG LDO 3.3V/1.8V 10-MLF |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS34T108GN+ | 功能描述:以太网 IC Octal TDM Over Packet Chip RoHS:否 制造商:Micrel 产品:Ethernet Switches 收发器数量:2 数据速率:10 Mb/s, 100 Mb/s 电源电压-最大:1.25 V, 3.45 V 电源电压-最小:1.15 V, 3.15 V 最大工作温度:+ 85 C 封装 / 箱体:QFN-64 封装:Tray |
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