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参数资料
| 型号： | DS34T108GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 303/366页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 484HSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 30 |
| 类型： | TDM（分时复用） |
| 应用： | 数据传输 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA 裸露焊盘 |
| 供应商设备封装： | 484-HSBGA（23x23） |
| 包装： | 托盘 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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PIN NAME
PIN DESCRIPTION
H_WR_BE2_N /
SPI_SEL_N
I
H_WR_BE2_N: Host Write Enable Byte 2 (Active Low)
In 32-bit parallel interface mode during a write access this pin specifies whether or
not byte 2 (H_D[15:8]) should be written to the device. In 16-bit parallel interface
mode this pin is ignored and should be pulled high or low.
0 = write byte 2
1 = don’t write byte 2
SPI_SEL: SPI Chip Select (Active Low)
In SPI interface mode this pin must be asserted (low) to read or write internal
registers.
H_WR_BE3_N /
SPI_CI
I
H_WR_BE3_N: Host Write Enable Byte 3 (Active Low)
In 32-bit parallel interface mode during a write access this pin specifies whether or
not byte 3 (H_D[15:8]) should be written to the device. In 16-bit parallel interface
mode this pin is ignored and should be pulled high or low.
0 = write byte 3
1 = don’t write byte 3
SPI_CI: SPI Clock Invert
In SPI interface mode this pin specifies the polarity of the SPI_CLK pin. See the
timing diagrams in Figure 14-11 and Figure 14-12 for details.
0 = SPI_CLK is normally low and pulses high (leading edge is rising edge)
1 = SPI_CLK is normally high and pulses low (leading edge is falling edge)
H_READY_N
O
8mA
Host Ready Output (Active Low)
In parallel interface mode the device pulls this pin low during a read or write
access to signal that the device is ready for the access to be completed. The host
processor should not pull H_CS_N high (inactive) to complete the access until the device
has pulled H_READY_N low.
This pin requires the use of an external pull-up resistor. The device actively drives
this pin high before allowing it to go high-impedance. See Figure 14-9.
H_INT[1:0]
O
8mA
Host Interrupt Outputs (Active Low)
H_INT[0] indicates interrupt requests from the TDMoP block. H_INT[1] indicates
interrupt requests from the LIU, framer and BERT. Optionally, the H_INT[1] signal
can be forced inactive at the H_INT[1] pin and internally ORed into the H_INT[0]
signal by setting GCR1.IPOR=1. This allows H_INT[0] to indicate interrupt
requests from any and all sources in the device. When GCR1.IPI0=1, H_INT[0] is
forced high (inactive). When GCR1.IPI1=1, H_INT[1] is forced high (inactive). See
section 10.9.
相关PDF资料 |
PDF描述 |
|---|---|
| DS34T104GN+ | IC TDM OVER PACKET 484TEBGA |
| DS34T101GN+ | IC TDM OVER PACKET 484TEBGA |
| MIC2211-GOYML TR | IC REG LDO 1.8V/2.9V 10-MLF |
| MIC2211-GJYML TR | IC REG LDO 1.8V/2.5V 10-MLF |
| MIC2211-SGYML TR | IC REG LDO 3.3V/1.8V 10-MLF |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS34T108GN+ | 功能描述:以太网 IC Octal TDM Over Packet Chip RoHS:否 制造商:Micrel 产品:Ethernet Switches 收发器数量:2 数据速率:10 Mb/s, 100 Mb/s 电源电压-最大:1.25 V, 3.45 V 电源电压-最小:1.15 V, 3.15 V 最大工作温度:+ 85 C 封装 / 箱体:QFN-64 封装:Tray |
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| DS3500N+T&R | 制造商:Maxim Integrated Products 功能描述:- Tape and Reel |
| DS3501 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:High-Voltage, NV, I2C POT with Temp Sensor and Lookup Table |
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