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参数资料
| 型号： | DS34T108GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 113/366页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 484HSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 30 |
| 类型： | TDM（分时复用） |
| 应用： | 数据传输 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA 裸露焊盘 |
| 供应商设备封装： | 484-HSBGA（23x23） |
| 包装： | 托盘 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
20 of 366
7 FEATURES
Global Features
TDMoP Interfaces
o
DS34T101: 1 E1/T1 LIU/Framer/TDMoP interface
o
DS34T102: 2 E1/T1 LIUs/Framers/TDMoP interfaces
o
DS34T104: 4 E1/T1 LIUs/Framers/TDMoP interfaces
o
DS34T108: 8 E1/T1 LIUs/Framers/TDMoP interfaces
o
All four devices: optionally 1 high-speed E3/DS3/STS-1 TDMoP interface
o
All four devices: each interface optionally configurable for serial operation for V.35 and RS530
Ethernet Interface
o
One 10/100 Mbps port configurable for MII, RMII or SSMII interface format
o
Half or full duplex operation
o
VLAN support according to 802.1p and 802.1Q including stacked tags
o
Fully compatible with IEEE 802.3 standard
End-to-end TDM synchronization through the IP/MPLS domain by on-chip, per-port TDM clock recovery
64 independent bundles/connections, each with its own:
o
Transmit and receive queues
o
Configurable jitter-buffer depth
o
Connection-level redundancy, with traffic duplication option
Flexible on-chip cross-connection capability
o
Internal bundle cross-connect capability, with DS0 resolution
o
Any framer receiver port to any TDMoP block receive interface to maintain bundle connectivity
o
Any TDMoP block transmit interface to any framer transmit port to maintain bundle connectivity
Packet loss compensation and handling of misordered packets
Glueless SDRAM interface
Complies with MPLS-Frame Relay Alliance Implementation Agreements 4.1, 5.1 and 8.0
Complies with ITU-T standards Y.1413 and Y.1414.
Complies with Metro Ethernet Forum 3 and 8
Complies with IETF RFC 4553 (SAToP), RFC 5086 (CESoPSN) and RFC 5087 (TDMoIP)
IEEE 1146.1 JTAG boundary scan
1.8V and 3.3V Operation with 5.0V tolerant I/O
Clock Synthesizers
Clocks to operate LIUs, jitter attenuators, framers, BERTs and HDLC controllers can be synthesized from a
single clock input for both E1 and T1 operation (10MHz, 19.44MHz, 38.88MHz or 77.76MHz on the CLK_HIGH
pin or 1.544MHz or 2.048MHz on the MCLK pin)
Clocks to operate the TDMoP clock recovery machines can synthesized from a single clock input (10MHz,
19.44MHz, 38.88MHz or 77.76MHz on the CLK_HIGH pin)
Clock to operate TDMoP logic and SDRAM interface (50MHz or 75MHz) can be synthesized from a single
25MHz clock on the CLK_SYS pin
Line Interface Units (LIUs)
Receives E1, T1 and G.703 2048kHz synchronization signal
Fully software configurable including software-selectable internal Tx and Rx termination
Suitable for both short-haul and long-haul applications
Receive sensitivity options from (0dB to -12dB) to (0dB to -43dB) for E1 and to (0dB to -36dB) for T1
Receive signal level indication: 0dB to -37.5dB
Internal receive termination options for 75
, 100, 110, and 120 lines
Receive monitor-mode gain settings of 14dB, 20dB, 26dB, and 32dB
Flexible transmit waveform generation
相关PDF资料 |
PDF描述 |
|---|---|
| DS34T104GN+ | IC TDM OVER PACKET 484TEBGA |
| DS34T101GN+ | IC TDM OVER PACKET 484TEBGA |
| MIC2211-GOYML TR | IC REG LDO 1.8V/2.9V 10-MLF |
| MIC2211-GJYML TR | IC REG LDO 1.8V/2.5V 10-MLF |
| MIC2211-SGYML TR | IC REG LDO 3.3V/1.8V 10-MLF |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS34T108GN+ | 功能描述:以太网 IC Octal TDM Over Packet Chip RoHS:否 制造商:Micrel 产品:Ethernet Switches 收发器数量:2 数据速率:10 Mb/s, 100 Mb/s 电源电压-最大:1.25 V, 3.45 V 电源电压-最小:1.15 V, 3.15 V 最大工作温度:+ 85 C 封装 / 箱体:QFN-64 封装:Tray |
| DS35 | 制造商:LUMILEDS 制造商全称:LUMILEDS 功能描述:power light source Luxeon Dental |
| DS3500N+ | 制造商:Maxim Integrated Products 功能描述:- Rail/Tube |
| DS3500N+T&R | 制造商:Maxim Integrated Products 功能描述:- Tape and Reel |
| DS3501 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:High-Voltage, NV, I2C POT with Temp Sensor and Lookup Table |
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