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参数资料
| 型号： | DS34T108GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 179/366页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 484HSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 30 |
| 类型： | TDM（分时复用） |
| 应用： | 数据传输 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 484-BGA 裸露焊盘 |
| 供应商设备封装： | 484-HSBGA（23x23） |
| 包装： | 托盘 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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8.1.1 Internal One-Clock Mode
In internal one-clock mode (GCR1.CLKMODE=0) the receive direction of each TDM port uses the same clock as
the transmit direction of that port. The transmit formatter and the receive framer are therefore synchronized
together. Since the data received from the LIU receiver or the RDATFn pin is clocked by a different clock (either the
clock recovered by the LIU or the RCLKFn pin) the framer’s receive elastic store must be enabled so that the
difference between clock frequencies is handled by control slips in the elastic store.
Figure 8-2 is a simplified diagram of internal one-clock mode. The CLKCNTLn fields in the FMRTOPISM registers
specify the clock to be used for each port. Choices include any of the TSYSCLKn/ECLKn input pins, any of the LIU
recovered clocks on the RCLKn pins, any of the TDMoP recovered clocks on the TDMn_ACLK pins, or the E1CLK
or T1CLK master clocks from the CLAD1 block. See the ref_clk[n] signal in Figure 6-2. In addition, the SYNCNTLn
fields in the FMRTOPISM registers specify the frame-sync pulse to be used for each port. Each port can be
configured to use any TSYNC out from any active transmit formatter. See the tsync_ref[n] signal in Figure 6-2.
Figure 8-2. Internal One-Clock Mode
Framer port n
TCLKn
TSERn
TSYNCn
TSIGn
RSYSCLKn
RSERn
RSYNCn
RSIGn
TDMoP Block port n
TDMn_ACLK
TDMn_TCLK
TDMn_TX
TDMn_TX_SYNC
TDMn_TX_MF*
TDMn_TSIG
TDMn_RCLK
TDMn_RX
TDMn_RX_SYNC
TDMn_RSIG
TCLKOn
TPOSn
TNEGn
RCLKn
RPOSn
RNEGn
ACLKn
RCLKn
Connected to LIU
TSYNC
TSYNC[8..1]
*Note: The internal signal input "TDMn_TX_MF" is a don't care when configured in framed mode.
SYNCNTL
bits
ECLK[8..1] pin
ACLK[8..1]
RCLK[8..1]
CLKCNTL
bits
E1CLK
T1CLK
8.1.2 Internal Two-Clock Mode
In internal two-clock mode (GCR1.CLKMODE=1) the receive direction and the transmit direction of each TDM port
have separate clocks. In this mode data is clocked all the way through the receive framer by the LIU’s recovered
clock or the RCLKFn signal and therefore the framer’s receive elastic store does not need to be enabled.
Figure 8-3 is a simplified diagram of internal two-clock mode for framed and multiframed applications. The
CLKCNTLn fields in the FMRTOPISM registers specify the clock to be used for the transmit side of each port.
Choices include any of the TSYSCLKn/ECLKn input pins, any of the LIU recovered clocks on the RCLKn pins, any
of the TDMoP recovered clocks on the TDMn_ACLK pins, or the E1CLK or T1CLK master clocks from the CLAD1
block. See the ref_clk[n] signal in Figure 6-2. In addition, the SYNCNTLn fields in the FMRTOPISM registers
specify the frame-sync pulse to used for the transmit side of each port. Each port can be configured to use any
TSYNC out from any active transmit formatter. See the tsync_ref[n] signal in Figure 6-2. On the receive side, the
clock is typically the RCLKn signal for the port as shown in Figure 8-3 while the frame sync signal is the
RF/MSYNCn signal.
If framing is not needed for a particular application, the device can be configured for unframed mode by setting
GCR1.UNFRMMODE=1. In this mode receive frame sync and signaling are squelched between the framer and the
TDMoP block. See Figure 6-2 and the simplified diagram of unframed mode in Figure 8-4 for details.
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PDF描述 |
|---|---|
| DS34T104GN+ | IC TDM OVER PACKET 484TEBGA |
| DS34T101GN+ | IC TDM OVER PACKET 484TEBGA |
| MIC2211-GOYML TR | IC REG LDO 1.8V/2.9V 10-MLF |
| MIC2211-GJYML TR | IC REG LDO 1.8V/2.5V 10-MLF |
| MIC2211-SGYML TR | IC REG LDO 3.3V/1.8V 10-MLF |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS34T108GN+ | 功能描述:以太网 IC Octal TDM Over Packet Chip RoHS:否 制造商:Micrel 产品:Ethernet Switches 收发器数量:2 数据速率:10 Mb/s, 100 Mb/s 电源电压-最大:1.25 V, 3.45 V 电源电压-最小:1.15 V, 3.15 V 最大工作温度:+ 85 C 封装 / 箱体:QFN-64 封装:Tray |
| DS35 | 制造商:LUMILEDS 制造商全称:LUMILEDS 功能描述:power light source Luxeon Dental |
| DS3500N+ | 制造商:Maxim Integrated Products 功能描述:- Rail/Tube |
| DS3500N+T&R | 制造商:Maxim Integrated Products 功能描述:- Tape and Reel |
| DS3501 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:High-Voltage, NV, I2C POT with Temp Sensor and Lookup Table |
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