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参数资料
| 型号： | IBM21P100BGB |
| 元件分类： | 总线控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA304 |
| 封装： | 31 X 31 MM, HEAT SINK, PLASTIC, BGA-304 |
| 文件页数： | 132/140页 |
| 文件大小： | 2032K |
| 代理商： | IBM21P100BGB |
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IBM21P100BGB
IBM 133 PCI-X Bridge R1.1
ppb11_pcix_regs.fm.03
July 9, 2001
Configuration Registers
Page 83 of 131
5.2.5.26 Power Management Control/Status Register
The Power Management Capabilities register reports status information about the secondary interface.
Address Offset
x‘94’
Access
See bit descriptions
Reset Value
x‘0000’
PM
E
S
ta
tu
s
Data
S
c
ale
Data
S
e
lec
t
P
M
E
na
bl
e
Res
e
rv
ed
Po
w
e
r
S
ta
te
15 14 13 12 11 10
9
876543210
Bit(s)
Access
Field Name and Description
15
RO
PME Status
Forced to b‘0’ to indicate that this device does not support the PME# pin.
14:13
RO
Data Scale
Forced to b‘00’ to indicate that this device does not implement the Data register.
12:9
RO
Data Select
Forced to b‘0000’ to indicate that this device does not implement the Data register.
8RO
PME Enable
Forced to b‘0’ to indicate that this device does not support PME# generation.
7:2
RO
Reserved
1:0
RW
Power State
This 2-bit field is used to both determine and reflect the current power state of the device. If an un-implemented
power state is written to this register, the bridge completes the write transaction, ignores the write data, and
does not change the value of this field. Writing a value of D0 when the previous state was D3 will cause a
device reset to occur (without activating the secondary RST#).
00
D0
01
D1 (not implemented)
10
D2 (not implemented)
11
D3
相关PDF资料 |
PDF描述 |
|---|---|
| IBM21P100BGC | PCI BUS CONTROLLER, PBGA304 |
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| IBM25EMPPC603EFG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, PQFP240 |
| IBM25EMPPC603EBG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, CBGA255 |
相关代理商/技术参数 |
参数描述 |
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