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参数资料
| 型号： | IBM21P100BGB |
| 元件分类： | 总线控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA304 |
| 封装： | 31 X 31 MM, HEAT SINK, PLASTIC, BGA-304 |
| 文件页数： | 56/140页 |
| 文件大小： | 2032K |
| 代理商： | IBM21P100BGB |
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IBM21P100BGB
IBM 133 PCI-X Bridge R1.1
Bus Operation
Page 14 of 131
ppb11_operations.fm.03
July 9, 2001
As indicated in
Bridge R1.1:
The bridge never initiates a transaction with a reserved command code and, as a target, the bridge
ignores reserved command codes.
The bridge never initiates an interrupt acknowledge transaction and, as a target, the bridge ignores inter-
rupt acknowledge transactions. Interrupt acknowledge transactions are expected to reside entirely on the
primary bus closest to the host bridge.
The bridge does not respond to special cycle transactions. To generate special cycle transactions on
other buses, either upstream or downstream, a Type 1 configuration command must be used.
The bridge does not generate Type 0 configuration transactions on the primary interface, nor does it respond
to Type 0 configuration transactions on the secondary interface.
Table 2: PCI-X Transactions
Command
Code
Type of Transaction
Initiates as Master
Responds as Target
Primary
Secondary
Primary
Secondary
0000
Interrupt Acknowledge
No
0001
Special Cycle
Yes
No
0010
I/O Read
Yes
0011
I/O Write
Yes
0100
Reserved
No
0101
Reserved
No
0110
Memory Read
Yes
0111
Memory Write
Yes
1000
Alias to Memory Read Block
No
Yes
1001
Alias to Memory Write Block
No
Yes
1010
Configuration Read
No
Yes
No
1011
Configuration Write
Type 1
Yes
Type 1
1100
Split Completion
Yes
1101
Dual Address Cycle
Yes
1110
Memory Read Block
Yes
1111
Memory Write Block
Yes
相关PDF资料 |
PDF描述 |
|---|---|
| IBM21P100BGC | PCI BUS CONTROLLER, PBGA304 |
| IBM25403GCX-3JC76C2 | RISC PROCESSOR, PQFP16 |
| IBM25405GP-3BA200C2 | RISC PROCESSOR, PBGA456 |
| IBM25EMPPC603EFG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, PQFP240 |
| IBM25EMPPC603EBG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, CBGA255 |
相关代理商/技术参数 |
参数描述 |
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| IBM25403GCX3JC76C2 | 制造商:IBM 功能描述: |
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