- 您现在的位置：买卖IC网 > PDF目录67681 > IBM21P100BGC PCI BUS CONTROLLER, PBGA304 PDF资料下载
参数资料
| 型号： | IBM21P100BGC |
| 元件分类： | 总线控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA304 |
| 封装： | 31 X 31 MM, PLASTIC, BGA-304 |
| 文件页数： | 113/144页 |
| 文件大小： | 5197K |
| 代理商： | IBM21P100BGC |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页当前第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页
IBM21P100BGC
IBM 133 PCI-X Bridge R2.0
Configuration Registers
Page 70 of 144
ppb20_pcix_regs.fm.01
October 15, 2001
5.2.5.4 Arbiter Mode Register
This register provides controls for the secondary bus arbitration logic on the bridge.
Address Offset
x‘50’
Access
See bit descriptions for details
Reset Value
x’0800’
When S_INT_ARB_EN# (pin T21) is tied low. See
for details of strapping considerations.
Reset Value
x’0801’
When S_INT_ARB_EN# (pin T21) is tied high. See
for details of strapping considerations.
A
rbi
te
r
F
ai
rn
e
s
C
ou
nt
e
r
Re
s
e
rv
e
d
B
rok
en
Mas
te
r
T
imeo
u
t
E
na
bl
e
Ex
te
rn
a
l
Arb
it
e
r
b
it
15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Bit(s)
Access
Field Name and Description
15:8
RW
Arbiter Fairness Counter
This is the initialization value of a counter used by the internal arbiter. It controls the number of PCI bus cycles
that the arbiter holds a device’s PCI bus grant active after detecting a PCI bus request from another device. The
counter is reloaded whenever a new PCI bus grant is asserted. For every new PCI bus grant, the counter is
armed to decrement when it detects the new fall of FRAME#. If the arbiter fairness counter is set to x‘00’,the
arbiter will not remove a device’s PCI bus grant until the device has deasserted its PCI bus request.
The reset value is x‘08’.
7:2
RO
Reserved
1
RW
Broken Master Timeout Enable
This bit enables the internal arbiter to count 16 PCI bus cycles while waiting for FRAME# to become active
whenadevice’s PCI Bus Grant is active and the PCI bus is idle. If the Broken Master Timeout expires the PCI
Bus Grant for the device is de-asserted.
0
Broken Master Timeout disabled.
1
Broken Master Timeout enabled.
The reset value is b‘0’.
0
RO
External Arbiter bit
This status bit reflects whether the bridge is in internal or external arbiter mode. The value is set at reset time,
according to the polarity of the S_INT_ARB_EN# I/O pin.
0
Internal arbiter in control.
1
External arbiter in control.
相关PDF资料 |
PDF描述 |
|---|---|
| IBM25403GCX-3JC76C2 | RISC PROCESSOR, PQFP16 |
| IBM25405GP-3BA200C2 | RISC PROCESSOR, PBGA456 |
| IBM25EMPPC603EFG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, PQFP240 |
| IBM25EMPPC603EBG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, CBGA255 |
| IBM25EMPPC740LDBC4000 | 32-BIT, 400 MHz, RISC PROCESSOR, CBGA255 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IBM24L5086 | 制造商:AVED MEMORY PRODUCTS 功能描述: 制造商:AVED Memory Products 功能描述: |
| IBM25403GCX-3BC80C2 | 制造商:IBM 功能描述:RISC PROCESSOR, 160 Pin Plastic BGA |
| IBM25403GCX-3JC50C2 | 制造商:IBM 功能描述:403GCX-3JC50C2 |
| IBM25403GCX-3JC66C2 | 制造商:IBM 功能描述: |
| IBM25403GCX3JC76C2 | 制造商:IBM 功能描述: |
发布紧急采购，3分钟左右您将得到回复。