参数资料
型号: LFE3-35EA-6FN484C
厂商: LATTICE SEMICONDUCTOR CORP
元件分类: FPGA
中文描述: FPGA, PBGA484
封装: 23 X 23 MM, LEAD FREE, FPBGA-484
文件页数: 59/130页
文件大小: 2667K
代理商: LFE3-35EA-6FN484C
2-31
Architecture
Lattice Semiconductor
LatticeECP3 Family Data Sheet
Programmable I/O Cells (PIC)
Each PIC contains two PIOs connected to their respective sysI/O buffers as shown in Figure 2-32. The PIO Block
supplies the output data (DO) and the tri-state control signal (TO) to the sysI/O buffer and receives input from the
buffer. Table 2-11 provides the PIO signal list.
Figure 2-32. PIC Diagram
ONEGB
TS
INA
IPA
DEL[3:0]
ECLK1, ECLK2
SCLK
CE
LSR
ECLK1
ECLK2
SCLK
READ
DCNTL[5:0]
DYNDEL[7:0]
DQSI
PRMDET
GSRN
DDRLAT*
DDRCLKPOL*
ECLKDQSR*
DQCLK0*
DQCLK1*
DQSW*
CLK
CEOT
CEI
sysIO
Buffer
PADA
“T”
PADB
“C”
LSR
GSR
* Signals are available on left/right/top edges only.
** Signals are available on the left and right sides only
*** Selected PIO.
IOLD0
DI
Tristate
Register
Block
Output
Register
Block
(ISI)
Input
Register
Block
Control
Muxes
Read Control
Write Control
PIOB
PIOA
OPOSA
OPOSB
ONEGA**
ONEGB**
IPB
INCK
INDD
INB
IOLT0
I/Os in a DQS-12 Group, Except DQSN (Complement of DQS) I/Os
DQS Control Block
(One per DQS Group of 12 I/Os)***
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PDF描述
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