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参数资料
| 型号： | ORLI10G1BM680-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1296 CLBS, 333000 GATES, PBGA680 |
| 封装： | PLASTIC, FBGA-680 |
| 文件页数： | 38/78页 |
| 文件大小： | 1689K |
| 代理商： | ORLI10G1BM680-DB |
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Lattice Semiconductor
ORCA ORLI10G Data Sheet
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Figure 29 shows the Transmit (FPGA to embedded Line Interface) timing for 10G mode where PLL_TX2 is
bypassed via the PLL_BYPASS external FPSC pin. The 0.4 ns setup time and the 1.1 ns hold time shown are
approximate values for the embedded line interface. Consult the ispLEVER software, via the static timing analysis
tool TRACE, for the exact timing values. Figure 29 shows a half cycle transfer. Designers should make sure to sat-
isfy the hold requirement. A full cycle transfer is also possible for this scenario when the clock period is 10 ns or
longer (< 100 MHz).
Figure 29. Transmit Timing for 10G Mode with PLL Bypassed (-1 Speed Grade)
0.4ns Setup
Launch
Capture
TX_CLK8_IN_BUF
1.3ns
1.6ns
3ns
TX_DAT_IN
Primary
FPGA Clock
Tree
Clock
Divider
PLL_TX2
(Bypass Mode)
Q
TX2_VCOP
Embedded Line Interface Core
FPGA
D
TX_CLK_IN
(644 MHz)
0.0ns
3.1ns
6.2ns
9.3ns
12.4ns
TX2_VCOP
(Reference Clock)
3.0ns
9.2ns
FPGA Clock
0.3ns
3.4ns
6.5ns
9.6ns
12.7ns
TX_CLK8_IN_BUF
Data
-0.1ns
6.1ns
12.3ns
1.1ns Hold
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PDF描述 |
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| ORLI10G-2BM680C | 功能描述:FPGA - 现场可编程门阵列 10368 LUT 316 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| ORLI10G-2BM680I | 功能描述:FPGA - 现场可编程门阵列 10368 LUT 316 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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