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参数资料
| 型号： | CXA3266Q |
| 元件分类： | PLL合成/DDS/VCOs |
| 英文描述： | PHASE LOCKED LOOP, 0.12 MHz, PQFP48 |
| 封装： | PLASTIC, QFP-48 |
| 文件页数： | 34/62页 |
| 文件大小： | 929K |
| 代理商： | CXA3266Q |
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CXA3266Q
- 4 -
Block Diagram
TTLOUT
Coarse
Delay
TTLOUT
1
bit
on/off
1
bit
on/off
1
bit
on/off
TTLOUT
1
bit
on/off
1
bit
on/off
PECL
on/off
DIV
1,
2,
4,
8
MUX
VCO
Fine
Delay
Charge
Pump
Phase
Detector
PECLIN
TTLIN
PECLIN
TTLIN
Polarity
TTLIN
Programmable
Counter
whole
chip
power
save
synthesizer
power
save
TTLIN
TTLOUT
CONTROL
REGISTER
DAC
RSET
1/2
2
bits
1
bit
6
bits
2
bits
1
bit
12
bits
1/256
to
1/4096
1/32
to
64/32
CLK
1
bit
1
bit
1
bit
CS
TLOAD
DIVOUT
SEROUT
SDATA
SCLK
SENABLE
IREF
Polarity
1
bit
2
bits
Latch
logic
1
bit
on/off
1
bit
on/off
RC2
RC1
VCO
(TTL)
VCO
(PECL)
SYNC
(TTL)
SYNC
(PECL)
HOLD
(TTL)
read
out
TTLOUT
2
to
5
CLK
DSYNC
(TTL)
DSYNC
(PECL)
CLK
(TTL)
NCLK
(TTL)
CLK
(PECL)
CLK/2
(TTL)
NCLK/2
(TTL)
CLK/2
(PECL)
UNLOCK
VBB
PECLOUT
unlock
detect
DSYNC
Hold
1
bit
2
bits
VOCLP
DIV
pulse
width
SW
Coarse
Delay
1
bit
1
to
2
CLK
1
bit
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PDF描述 |
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