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参数资料
| 型号： | CXA3266Q |
| 元件分类： | PLL合成/DDS/VCOs |
| 英文描述： | PHASE LOCKED LOOP, 0.12 MHz, PQFP48 |
| 封装： | PLASTIC, QFP-48 |
| 文件页数： | 40/62页 |
| 文件大小： | 929K |
| 代理商： | CXA3266Q |
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CXA3266Q
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2. Recommended TTL I/O circuit
The peripheral circuits mainly use TTL for digital input and output. Of course, PECL and TTL can also be mixed.
3
GND
Control
Register
HOLD
100pF
0.068F
3.0k
680pF
Loop Filter 4
3.0k
100
VCC
UNLOCK output 2
GND
100k
10nF
TTL level output pins
IOV
CC
IOGND
VCOH
VCOL
VCO
HOLD
SYNCH
SYNCL
SYNC
SENABLE
SCLK
SDATA
PECLV
CC
VBB
DSYNCH
DSYNCL
CLKH
CLKL
CLK/2H
CLK/2L
PECLV
CC
IOGND
TTLV
CC
TTLGND DSYNC
CLK
CLKN
CLK/2
CLK/2N
DGND
DVCC
UNLOCK
DIVOUT
SEROUT
CS
TLOAD
IOGND
VOCLP
PLLVCC
PLLGND
VCOVCC
VCOGND
VCOHGND
IREF
RC2
RC1
IRGND
IRVCC
13
14
15
16
17
18
19
20
21
22
23
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30
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39
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47
48
11
12
1
2
3
4
5
6
7
8
9
10
Note)
1 Unless otherwise specified, all capacitors are 0.1F.
2 Vary the external resistor and capacitor values of the
UNLOCK output as necessary.
3 This external resistor (3.0k) should be a metal film
resistor in consideration of temperature characteristics.
4 The loop filter's capacitors and resistor should also be
temperature compensated.
SYNC: TTL level input
VCC (+5.0V)
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