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参数资料
| 型号： | DS3112+W |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 104/133页 |
| 文件大小： | 0K |
| 描述： | IC MUX T3/E3 3.3V 256-PBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 40 |
| 控制器类型： | 调帧器，多路复用器 |
| 接口： | 并行/串行 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 电流 - 电源： | 150mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-PBGA（27x27） |
| 包装： | 管件 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页当前第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页
DS3112
72 of 133
Register Name:
T1E1DLB1
Register Description:
T1/E1 Diagnostic Loopback Control Register 1
Register Address:
54h
Bit #
7
6
5
4
3
2
1
0
Name
DLB8
DLB7
DLB6
DLB5
DLB4
DLB3
DLB2
DLB1
Default
0
Bit #
15
14
13
12
11
10
9
8
Name
DLB16
DLB15
DLB14
DLB13
DLB12
DLB11
DLB10
DLB9
Default
0
Note: Bits that are underlined are read-only; all other bits are read-write.
Bits 0 to 15: T1/E1 Diagnostic Loopback Enable for Ports 1 to 16 (DLB1 to DLB16). These bits enable or
disable the T1/E1 Diagnostic Loopback (DLB). See the block diagrams in Section 1 for a visual description of this
loopback. DLB1 corresponds to T1/E1 Port 1, DLB2 corresponds to T1/E1 Port 2, and so on. If the device is
configured in Low-Speed T1/E1 Port Loop Timed mode (if LLTM bit in the MC1 register is set to a one) then only
data will be looped back—the clock will not be looped back. Since ports 4, 8, 12, 16, 20, 24, and 28 are not active
in the G.747 mode, the DLB4, DLB8, DLB12, and DLB16 bits have no effect in the G.747 mode.
0 = disable loopback
1 = enable loopback
Register Name:
T1E1DLB2
Register Description:
T1/E1 Diagnostic Loopback Control Register 2
Register Address:
56h
Bit #
7
6
5
4
3
2
1
0
Name
DLB24
DLB23
DLB22
DLB21
DLB20
DLB19
DLB18
DLB17
Default
0
Bit #
15
14
13
12
11
10
9
8
Name
—
DLB28
DLB27
DLB26
DLB25
Default
—
0
Note: Bits that are underlined are read-only; all other bits are read-write.
Bits 17 to 28: T1 Diagnostic Loopback Enable for Ports 17 to 28 (DLB17 to DLB28). These bits enable or
disable the T1 Diagnostic Loopback (DLB). See the block diagrams in Section 1 for a visual description of this
loopback. DLB1 corresponds to T17 Port 17, DLB18 corresponds to T1 Port 18, and so on. Since ports 17 to 28 are
not active in the E3 mode, these bits have no effect in the E3 mode. Since ports 4, 8, 12, 16, 20, 24, and 28 are not
active in the G.747 Mode, the DLB20, DLB24 and DLB28 bits have no affect in the G.747 mode. If the device is
configured in Low-Speed T1/E1 Port Loop Timed mode (if LLTM bit in the MC1 register is set to a one), then
only data will be looped back, the clock will not be looped back.
0 = disable loopback
1 = enable loopback
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