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参数资料
| 型号： | DS3112+W |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 116/133页 |
| 文件大小： | 0K |
| 描述： | IC MUX T3/E3 3.3V 256-PBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 40 |
| 控制器类型： | 调帧器，多路复用器 |
| 接口： | 并行/串行 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 电流 - 电源： | 150mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-PBGA（27x27） |
| 包装： | 管件 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页当前第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页
DS3112
83 of 133
Bit #
Register Name:
BERTRP0
Register Description:
BERT Repetitive Pattern 0 (lower word)
Register Address:
74h
7
6
5
4
3
2
1
0
Name
RP7
RP6
RP5
RP4
RP3
RP2
RP1
RP0
Default
0
Bit #
15
14
13
12
RP12
11
10
9
8
Name
RP15
RP14
RP13
RP11
RP10
RP9
RP8
Default
0
Register Name:
BERTRP1
Register Description:
BERT Repetitive Pattern 1 (upper word)
Register Address:
76h
Bit #
7
6
5
4
3
2
1
0
Name
RP23
RP22
RP21
RP20
RP19
RP18
RP17
RP16
Default
0
Bit #
15
14
13
12
11
10
9
8
Name
RP31
RP30
RP29
RP28
RP27
RP26
RP25
RP24
Default
0
Note: Bits that are underlined are read-only; all other bits are read-write.
Bits 0 to 31: BERT Repetitive Pattern Set (RP0 to RP31). RP0 is the LSB and RP31 is the MSB. These registers
must be properly loaded for the BERT to properly generate and synchronize to either a repetitive pattern, a
pseudorandom pattern, or a alternating word pattern. For a repetitive pattern that is less than 17 bits, then the
pattern should be repeated so that all 32 bits are used to describe the pattern. For example, if the pattern was the
repeating 5-bit pattern …01101… (where rightmost bit is one sent first and received first) then BERTRP0 should
be loaded with xB5AD and BERTRP1 should be loaded with x5AD6. For a pseudorandom pattern, both registers
should be loaded with all ones (i.e., xFFFF). For an alternating word pattern, one word should be placed into
BERTRP0 and the other word should be placed into BERTRP1. For example, if the DDS stress pattern “7E” is to
be described, the user would place x0000 in BERTRP0 and x7E7E in BERTRP1 and the alternating word counter
would be set to 50 (decimal) to allow 100 bytes of 00h followed by 100 bytes of 7Eh to be sent and received.
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