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参数资料
| 型号： | AD9520-0BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 7/80页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN 2.8GHZ VCO 64LFCSP |
| 设计资源： | Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121) Phase Coherent FSK Modulator (CN0186) |
| 标准包装： | 750 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:12，2:24 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.95GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 带卷 (TR) |
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Data Sheet
AD9520-0
Rev. A | Page 15 of 80
PD, EEPROM, RESET, AND SYNC PINS
Table 15.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
INPUT CHARACTERISTICS
Each pin has a 30 k internal pull-up resistor
Logic 1 Voltage
2.0
V
Logic 0 Voltage
0.8
V
Logic 1 Current
1
A
Logic 0 Current
110
A
The minus sign indicates that current is flowing out of
the AD9520, which is due to the internal pull-up resistor
Capacitance
2
pF
RESET TIMING
Pulse Width Low
500
ns
RESET Inactive to Start of Register
Programming
100
ns
SYNC TIMING
Pulse Width Low
1.3
ns
High speed clock is CLK input signal
SERIAL PORT SETUP PINS—SP1, SP0
Table 16.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
SP1, SP0
These pins do not have internal pull-up/pull-down
resistors
Logic Level 0
0.25 × VS
V
VS is the voltage on the VS pin
Logic Level
0.4 × VS
0.65 × VS
V
These pins can be floated to obtain Logic Level ;
if floating the pin, connect a capacitor to ground
Logic Level 1
0.8 × VS
V
LD, STATUS, AND REFMON PINS
Table 17.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
OUTPUT CHARACTERISTICS
When selected as a digital output (CMOS); there are other
modes in which these pins are not CMOS digital outputs;
see Table 54, Register 0x017, Register 0x01A, and
Register 0x01B
Output Voltage High, VOH
2.7
V
Output Voltage Low, VOL
0.4
V
MAXIMUM TOGGLE RATE
100
MHz
Applies when mux is set to any divider or counter output,
or PFD up/down pulse; also applies in analog lock detect
mode; usually debug mode only; beware that spurs can
couple to output when any pin is toggling
ANALOG LOCK DETECT
Capacitance
3
pF
On-chip capacitance; used to calculate RC time constant
for analog lock detect readback; use a pull-up resistor
REF1, REF2, AND VCO FREQUENCY
STATUS MONITOR
Normal Range
1.02
MHz
Frequency above which the monitor indicates the presence
of the reference
Extended Range
8
kHz
Frequency above which the monitor indicates the presence
of the reference
LD PIN COMPARATOR
Trip Point
1.6
V
Hysteresis
260
mV
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PDF描述 |
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