参数资料
| 型号： | IP-FFT |
| 厂商： | Altera |
| 文件页数： | 16/70页 |
| 文件大小： | 0K |
| 描述： | IP FFT/IFFT |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 快速傅里叶变换处理器 |
| 许可证： | 初始许可证 |
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1–12
Chapter 1: About This MegaCore Function
Performance and Resource Utilization
4 multipliers/2 adders complex multiplier structure, for data and twiddle width 16,
for Stratix IV (EP4SGX70DF29C2X) devices.
Table 1–17. Resource Usage with Buffered Burst Data Flow Architecture—Stratix IV Devices
Points
256
1024
4096
256
1024
4096
256
1024
4096
Number of
Engines (1)
1
1
1
2
2
2
4
4
4
Combinational
ALUTs
1951
1990
2034
3262
3307
3348
5712
5774
5856
Logic
Registers
3586
3784
3968
5577
5785
5977
9970
10195
10401
Memory
(Bits)
30976
123136
491776
30976
123136
491776
30976
123136
491776
Memory
(M9K)
16
16
60
31
31
60
60
60
60
18 × 18
Blocks
12
12
12
24
24
24
48
48
48
f MAX
(MHz)
443
441
421
428
410
393
368
362
368
(1) When using the buffered burst architecture, you can specify the number of quad-output FFT engines in the FFT parameter editor.
4 multipliers/2 adders complex multiplier structure, for data and twiddle width 16,
for Stratix IV (EP4SGX70DF29C2X) devices.
Table 1–18. Performance with the Buffered Burst Data Flow Architecture—Stratix IV Devices
Transform Calculation
Data Load & Transform
Block Throughput
Points
Number of
Engines (1)
f MAX (MHz)
Time (2)
Cycles Time ( ? s)
Calculation
Cycles Time ( ? s)
Cycles
Time ( ? s)
256
1024
4096
256
1024
4096
256
1024
4096
1
1
1
2
2
2
4
4
4
443
441
421
428
410
393
368
362
368
235
1069
5167
162
557
2607
118
340
1378
0.53
2.42
12.26
0.38
1.36
6.64
0.32
0.94
3.75
491
2093
9263
397
1581
6703
347
1364
5474
1.11
4.75
21.98
0.93
3.85
17.07
0.94
3.77
14.89
331
1291
6157
299
1163
5133
283
1099
4633
0.75
2.93
14.61
0.7
2.84
13.07
0.77
3.04
12.61
(1) When using the buffered burst architecture, you can specify the number of quad-output engines in the FFT parameter editor. You may choose
from one, two, or four quad-output engines in parallel.
(2) In a buffered burst data flow architecture, transform time is defined as the time from when the N-sample input block is loaded until the first
output sample is ready for output. Transform time does not include the additional N-1 clock cycle to unload the full output data block.
(3) Block throughput is the minimum number of cycles between two successive start-of-packet (sink_sop) pulses.
FFT MegaCore Function
User Guide
November 2013 Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-FIR | IP FIR COMPILER |
| IP-NCO | IP NCO COMPILER |
| IP-NIOS | IP NIOS II MEGACORE |
| IP-PCI/MT64 | IP PCI 64BIT MASTER/TARGET |
| IP-PCIE/8 | IP PCI EXPRESS, X8 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPFH6N03LA G | 功能描述:MOSFET N-CH 25V 50A DPAK RoHS:是 类别:分离式半导体产品 >> FET - 单 系列:OptiMOS™ 标准包装:1,000 系列:MESH OVERLAY™ FET 型:MOSFET N 通道，金属氧化物 FET 特点:逻辑电平门 漏极至源极电压(Vdss):200V 电流 - 连续漏极(Id) @ 25° C:18A 开态Rds（最大）@ Id, Vgs @ 25° C:180 毫欧 @ 9A，10V Id 时的 Vgs(th)（最大）:4V @ 250µA 闸电荷(Qg) @ Vgs:72nC @ 10V 输入电容 (Ciss) @ Vds:1560pF @ 25V 功率 - 最大:40W 安装类型:通孔 封装/外壳:TO-220-3 整包 供应商设备封装:TO-220FP 包装:管件 |
| IPFH6N03LAG | 功能描述:MOSFET N-Channel MOSFET 20-200V RoHS:否 制造商:STMicroelectronics 晶体管极性:N-Channel 汲极/源极击穿电压:650 V 闸/源击穿电压:25 V 漏极连续电流:130 A 电阻汲极/源极 RDS（导通）:0.014 Ohms 配置:Single 最大工作温度: 安装风格:Through Hole 封装 / 箱体:Max247 封装:Tube |
| IP-FIR | 功能描述:开发软件 FIR Compiler MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IP-FIRII | 功能描述:开发软件 FIR Compiler II MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPFLBPT2 | 制造商:Carlo Gavazzi 功能描述:IL 35MM MUSH P-P PL 22MM RED |
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