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参数资料
| 型号： | M30955FJTGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | FLASH, 64 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件页数： | 277/579页 |
| 文件大小： | 12750K |
| 代理商： | M30955FJTGP |
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21.3.2
Phase-Delayed Waveform Output Mode
Output signal level from the IIOi_j pin is inverted every time the base timer value matches the GiPOj register (i
= 0, 1, j = 0 to 7). Table 21.9 lists specifications of phase-delayed waveform output mode.
Figure 21.18 lists an operation example of phase-delayed waveform output mode.
Table 21.9
Phase-Delayed Waveform Output Mode Specifications
NOTE:
1. Set the FSCj bit in the GiFS register to 0 (waveform generation function selected).
Item
Specification
Output waveform
The following applies when;
-Free-running operation (bits RST2 and RST1 in the GiBCR1 register are set
to 00b)
Cycle:
65536 x 2
fBTi
“H” and “L” widths:
65536
fBTi
Setting value of the GiPOj register, 0000h to FFFFh
The following applies when;
-The base timer becomes 0000h by matching the base timer value with the
GiPO0 register (bits RST1 and RST2 are set to 01b)
Cycle:
2(n+2)
fBTi
“H” and “L” widths:
n+2
fBTi
n: setting value of the GiPO0 register, 0001h to FFFDh
m: setting value of the GiPOp register (p = 1 to 7) register, 0000h to FFFFh
If GiPOj register
≥ n + 2, the output level is not inverted
Waveform output start condition(1) Set the IFEj bit in the GiFE register to 1 (channel j’s function enabled)
Waveform output stop condition
Set the IFEj bit to 0 (channel j’s function disabled)
Interrupt request
The POijR bit in the interrupt request register is set to 1 (interrupt requested)
when the base timer value matches the GiPOj register. (See Figure 10.18 IIO0IR
)
IIOi_ j pin (output)
Pulse output
Selectable function
Default value set function:
The output level when waveform output starts is set
Inverse output function:
The waveform output level is inverted and output from the IIOi_j pin
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