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参数资料
| 型号： | M30955FJTGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | FLASH, 64 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件页数： | 507/579页 |
| 文件大小： | 12750K |
| 代理商： | M30955FJTGP |
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27. Usage Notes
Rev.1.00
Page 530 of 551
27.7.3
INT Interrupt
Edge Sensitive
Each of “H” and “L” widths of signals applied to pins INT0 to INT8 must be 250 ns or more regardless of the
BCLK.
Level Sensitive
Each of “H” and “L” widths of signals applied to pins INT0 to INT8 must be 1 BCLK clock + 200 ns or more.
For example, each of “H” and “L” widths must be 234 ns or more if BCLK is 30 MHz.
The IR bit in the INTiIC register (i = 0 to 5) may become 1 (interrupt requested) when the polarity settings of
pins INT0 to INT5 are changed. Set the IR bit to 0 (interrupt not requested) after the polarity setting is changed.
Figure 27.3 shows an example of the switching procedure for an INTi interrupt source (i = 0 to 5).
Figure 27.3
Switching Procedure for INTi (i = 0 to 5) Interrupt Source
Start
Set the POL bit in the INTiIC register
Set the LVS bit in the INTiIC register to 0
Set the IFSRi bit in the IFSR register
Set bits ILVL2 to ILVL0 in the INTiIC register to 000b
Interrupt disabled
Select polarity (Set to 0 when both edge is selected)
Select edge sensitive
Select either one edge or both edge
Set the IR bit in the INTiIC register to 0
Clear the IR bit
End
< Procedure to set to Edge Sensitive >
< Procedure to set to Level Sensitive >
i = 0 to 5
Start
Set the POL bit in the INTiIC register
Set the LVS bit in the INTiIC register to 1
Set the IFSRi bit in the IFSR register to 0
Set bits ILVL2 to ILVL0 in the INTiIC register to 000b
Interrupt disabled
Select polarity
Select level sensitive
Select one edge
End
Set bits ILVL2 to ILVL0 in the INTiIC register
Interrupt enabled
Set the IR bit in the INTiIC register to 0
Clear the IR bit
Set bits ILVL2 to ILVL0 in the INTiIC register
Interrupt enabled
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PDF描述 |
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