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参数资料
| 型号： | NAND08GW3B2CZL1F |
| 厂商： | NUMONYX |
| 元件分类： | PROM |
| 英文描述： | 1G X 8 FLASH 3V PROM, 25000 ns, PBGA52 |
| 封装： | 12 X 17 MM, 1 MM PITCH, LEAD FREE, LGA-52 |
| 文件页数： | 22/72页 |
| 文件大小： | 1919K |
| 代理商： | NAND08GW3B2CZL1F |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页当前第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页
NAND04G-B2D, NAND08G-BxC
Device operations
Figure 13.
Multiplane page program waveform
1.
This address scheme refers to x8 devices, remember to use the appropriate scheme for x16 devices.
6.5
Copy back program
The copy back program operation is used to copy the data stored in one page and
reprogram it in another page.
The copy back program operation does not require external memory and so the operation is
faster and more efficient because the reading and loading cycles are not required. The
I/O
RB
Address inputs
ai13171c
Data input
11h
81h
80h
Page Program
setup code
Confirm
code
Multiplane Page
Program setup
code
Busy
tIPBSY
A0-A11 = Valid
Address inputs
SR0
Data input
10h
70h
Confirm
code
Read Status register
Busy
tBLBH2
(Program Busy time)
1
2
A12-A17 = set to 'Low'
A18 = set to 'Low'
A19-A28 = set to 'Low'
A0-A11 = Valid
A12-A17 = Valid
A18 = set to 'High'
A19-A28 = Valid
1) The same row address, except for A18, is applied to the two blocks.
2) Any command between 11h and 81h is prohibited except 70h and FFh.
80h
11h
81h
10h
Data
input
First plane
(1024 block)
Block 0
Block 2
Block 2044
Block 2046
.
Second plane
(1024 block)
Block 1
Block 3
Block 2045
Block 2047
.
a) Traditional protocol
b) ONFI 1.0 protocol
W
CL
AL
R
80h C1A C2A R1A R2A R3A
D0A D1A
...
DnA
11h
80h C1B C2B R1B R2B R3B
D0B D1B
...
I/O
RB
Busy
tIPBSY
Busy
tBLBH2
(Program Busy time)
DnB
10h
相关PDF资料 |
PDF描述 |
|---|---|
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| NAND128R4A2BZA6E | 8M X 16 FLASH 1.8V PROM, 35 ns, PBGA55 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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