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参数资料
| 型号： | RJ80530LZ001512 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 1000 MHz, MICROPROCESSOR, CPGA478 |
| 封装： | MICRO, FCPGA-478 |
| 文件页数： | 39/96页 |
| 文件大小： | 2018K |
| 代理商： | RJ80530LZ001512 |
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Electrical Specifications
R
44
Mobile Intel
Pentium III Processor-M Datasheet
Table 29. Enhanced Intel SpeedStep Technology AC Specifications
Symbol
Parameter
Min
Max
Unit Figure
Notes
T57
GHI# Setup Time from BCLK Restart or DPSLP#
deassertion
150
ns
19
Note 1
T58
GHI# Hold Time from BCLK Restart or DPSLP#
deassertion
30
s
19
Note 1
T59
GHI# Sample Delay
10
s
19
Note 1
T60
BCLK Settling Time
150
ns
19
Notes 2, 3
NOTES:
1.
GHI# is ignored until 10
s after BCLK, BCLK# stop or DPSLP# assertion, the setup and hold window must
occur after this time.
2.
BCLK, BCLK# must meet the BCLK AC specification from within 150 ns of turning on (rising above VIL,BCLK).
3.
This specification applies to the exit from the Deep Sleep state whether or not an Enhanced Intel SpeedStep
technology operating mode transition occurs.
Figure 6. BCLK (Single Ended)/PICCLK/TCK Generic Clock Timing Waveform
CLK
V
H
V
L
V
TRIP
Th
Tl
Tp
Tr
Tf
D0003-01
NOTES:
Tr=T5S, T5S1, T34, T25 (Rise Time)
Tf=T6S, T6S1, T35, T26 (Fall Time)
Th=T3S, T3S1, T32, T23 (High Time)
Tl=T4S, T4S1, T33, T24 (Low Time)
Tp=T1S, T1S1, T31, T22 (Period)
VTRIP=1.25V for BCLK (Single Ended);1.0V for PICCLK; 1.0V for TCK
VL=0.5V for BCLK (Single Ended);0.4V for PICCLK; (VCMOSREF-0.2V) for TCK
VH=2.0V for BCLK (Single Ended);1.6V for PICCLK; (VCMOSREF+0.2V) for TCK
Figure 7. Differential BCLK/BCLK# Waveform (Common Mode)
BCLK
BCLK#
Vcross
V2,V3 (max)
V1,V3 (min)
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PDF描述 |
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